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搜索资源列表

  1. b

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  2. A high-speed variable phase accumulator for an ADPLL architecture

  3. 所属分类：Other systems

    • 发布日期：2017-04-02
    • 文件大小：287766
    • 提供者：bc

  1. adpll

    0下载：
  2. All digital phase locked loop based clock multiplier design. No off chip components

  3. 所属分类：Other systems

    • 发布日期：2017-03-30
    • 文件大小：187509
    • 提供者：Abhishek

  1. ADPLL

    1下载：
  2. 学习资料。一个关于信号处理软件ADPLL的使用说明，很有用。-Learning materials. A signal processing software ADPLL of the instructions, very useful.

  3. 所属分类：Other systems

    • 发布日期：2017-04-03
    • 文件大小：301750
    • 提供者：fu
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