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  1. q

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  2. 数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时;显示满刻度为23时59分59秒,另外具备校时功能和报时功能。因此,一个基本的数字钟电路主要由“时”“分”“秒”计数器校时电路组成。将标准秒信号送入“秒计数器”,“秒计数器”采用60进制计数器,每累加60秒发送一个“分脉冲”信号,该信号将被送到“时计数器”。“时计数器”采用24进制计数器,可实现对一天24小时的累计。译码显示电路将“时”“分”“秒”计数器的输出状态六段显示译码器译码。通过六位LED七段显示器显示出
  3. 所属分类:Other systems

    • 发布日期:2017-04-04
    • 文件大小:6602
    • 提供者:李苏铭
  1. no_coherent

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  2. 基于差分相关的GPS信号检测算法,该算法和传统的相关累加进行了比较分析。-Based on Differential GPS-related signal detection algorithm and the traditional a comparative analysis of the relevant additive.
  3. 所属分类:Other systems

    • 发布日期:2017-04-02
    • 文件大小:2031
    • 提供者:zhoutian
  1. dds

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  2. 块DDS芯片中主要包括频率控制寄存器、高速相位累加器和正弦计算器三个部分(如Q2220)。频率控制寄存器可以串行或并行的方式装载并寄存用户输入的频率控制码;而相位累加器根据dds频率控制码在每个时钟周期内进行相位累加,得到一个相位值;正弦计算器则对该相位值计算数字化正弦波幅度(芯片一般通过查表得到)。DDS芯片输出的一般是数字化的正弦波,因此还需经过高速D/A转换器和低通滤波器才能得到一个可用的模拟频率信号。 -In the programming step, the electronic
  3. 所属分类:Other systems

    • 发布日期:2017-03-30
    • 文件大小:4849
    • 提供者:李彦伟
  1. fir

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  2. 是一个fir滤波器 其中使用了MAC单元去实现累加和乘法运算。-A fir filter which uses the MAC unit to achieve accumulation and multiplication.
  3. 所属分类:Other systems

    • 发布日期:2017-04-03
    • 文件大小:710
    • 提供者:张晓东
  1. 6

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  2. 高级表格置累加公式和置计算公式应用,很不错的易语言源码,适合易语言爱好者使用。-Advanced form set formula accumulate and set the formula applications, very good and easy language source code for easy language enthusiasts.
  3. 所属分类:其他小程序

    • 发布日期:2017-04-02
    • 文件大小:1131
    • 提供者:
  1. qiandaochengxu

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  2. C程序的,签到程序,包括签到的学号和和签到时分数累加等!-The C program, the check-in procedures, including attendance number and sign scores accumulation!
  3. 所属分类:Other windows programs

    • 发布日期:2017-04-10
    • 文件大小:1245
    • 提供者:jackie
  1. 11111s

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  2. 基于VC编的实现数的阶乘累加,和显示一些规则图片的功能-Based on the factorial of the number of VC addendum to the realization accumulate and display a picture of the function of some of the rules
  3. 所属分类:Other systems

    • 发布日期:2017-12-02
    • 文件大小:870280
    • 提供者:maxiang
  1. da_fir

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  2. 基于FPGA分布式算法FIR滤波器verilog代码 (本人 小论文 代码,通过验证) ​ 本文提出一种新的FIR滤波器FPGA实现方法。讨论了分布式算法原理,并提出了基于分布式算法FIR滤波器的实现方法。通过改进型分布式算法结构减少硬件资源消耗,用流水线技术提高运算速度,采用分割查找表方法减小存储规模,并在Matlab和Modelsim仿真平台得到验证。​ 为了节省FPGA逻辑资源、提高系统速度,设计中引入了分布式算法实现有限脉冲响应滤波器(F
  3. 所属分类:Other systems

    • 发布日期:2017-11-12
    • 文件大小:5827
    • 提供者:石康
  1. BinarySearchTree

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  2. 根据用户输入的一系列整数,生成一棵二叉查找树。对该二叉查找树实现中序遍历,生成排序后的整数数列。对该二叉查找树进行中序遍历,计算累加和。-According to a series of integer user input and generates a binary search tree. The realization of a binary search tree traversal generates integer sequence sorted. The binary searc
  3. 所属分类:Other windows programs

    • 发布日期:2017-04-13
    • 文件大小:2289
    • 提供者:牛遛遛
  1. LRC_Tool

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  2. c++ builder 版 累加和 及 LRC 校验和计算工具及源码-Tool and source code for sum and LRC of c++ builder
  3. 所属分类:Other windows programs

    • 发布日期:2017-04-30
    • 文件大小:312359
    • 提供者:angus-chen
  1. HHT

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  2. 基于经验模态分解法(EMD)的Hilbert-Huang变换(HHT)的MATLAB程序。 可将非平稳信号转换为平稳信号,通过将IMF分量累加重构得到平稳信号 。 主程序为HHT.m,需要用到hhspectrum.m函数、instfreq.m函数(在压缩包内)和已安装的EMD工具箱中emd函数。(The empirical mode decomposition (EMD) method based on Hilbert-Huang transform (HHT) of the MATLAB
  3. 所属分类:其他

    • 发布日期:2018-01-02
    • 文件大小:1024
    • 提供者:丑小鸭xpz
  1. fft - 副本

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  2. 进行FFT变换。任何连续测量的时序或信号,都可以表示为不同频率的正弦波信号的无限叠加。而根据该原理创立的傅立叶变换算法利用直接测量到的原始信号,以累加方式来计算该信号中不同正弦波信号的频率、振幅和相位。当然这是从数学的角度去看傅立叶变换。(Any continuous time sequence or signal can be expressed as an infinite superposition of sinusoidal signals of different frequencie
  3. 所属分类:其他

    • 发布日期:2018-04-29
    • 文件大小:1024
    • 提供者:MrY1
  1. 加减计算器

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  2. (1) 加减数和被加减数的输入位数为1-4位; (2) 相加结果显示要考虑进位的输出显示(即5位输出); (3) 注意对“0”—“9”、“+”、“=”以外按键输入的处理; (4) 注意对相加结果进行十进制处理; (5) 输入加数和被加数时,显示器上显示的数字要像平时用的计算器输入一样,即:每输入一个数字,原来显示的数字要往左移; (6) 可以完成累加功能。((1) The input digits of the additions and subtractions and the ad
  3. 所属分类:其他

    • 发布日期:2020-07-01
    • 文件大小:4096
    • 提供者:krkr
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