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  1. aes_cipher_top.rar

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  2. 密钥扩展模块的接口如图4.4。clk为系统时钟，kld为输入的加载信号，key为输入的128位密钥数据，wo_0, wo_1, wo_2, wo_3分别为输出的密钥列,密钥扩展模块的接口如图4.4。clk为系统时钟，kld为输入的加载信号，key为输入的128位密钥数据，wo_0, wo_1, wo_2, wo_3分别为输出的密钥列

  3. 所属分类：Crypt_Decrypt algrithms

    • 发布日期：2017-03-29
    • 文件大小：2717
    • 提供者：eee

  1. CRC_Rx

    0下载：
  2. 本设计为CRC5接收效验模块。本设计模块用来接收数据的CRC效验。本模块共需要5个时钟周期来完成：-CRC5 designed to receive this well-tested modules. The design module used to receive data CRC effectiveness. This module needs a total of 5 clock cycles to complete:

  3. 所属分类：Crypt_Decrypt algrithms

    • 发布日期：2017-04-02
    • 文件大小：1242
    • 提供者：黑月
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