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  1. USBipcore

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  2. usb1.1 ip核，使用verilog编写-usb1.1 ip nuclear, prepared using the Verilog

  3. 所属分类：USB develop

    • 发布日期：2017-04-23
    • 文件大小：156192
    • 提供者：liu

  1. USB-1.1-IP-CORE-VHDL

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  2. USB1.1标准接口的IP核的实现和其设计实现的源码范例VHDL-USB1.1 standard interface IP core implementations and examples of their design and implementation of the VHDL source code

  3. 所属分类：USB develop

    • 发布日期：2017-03-23
    • 文件大小：425965
    • 提供者：sxhfjgl010
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