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  1. SIN_fashengqi

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  2. 2006altera大赛-基于软核Nios的宽谱正弦信号发生器设计:摘要:本设计运用了基于 Nios II 嵌入式处理器的 SOPC 技术。系统以 ALTERA公司的 Cyclone 系列 FPGA 为数字平台,将微处理器、总线、数字频率合成器、存储器和 I/O 接口等硬件设备集中在一片 FPGA 上,利用直接数字频率合成技术、数字调制技术实现所要求波形的产生,用 FPGA 中的 ROM 储存 DDS 所需的波形表,充分利用片上资源,提高了系统的精确度、稳定性和抗干扰性能。使用新的数字信号处理(
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:407706
    • 提供者:刘斐
  1. 48taps_fir

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  2. 成形滤波可以在调制后对调制波以带通滤波方式完成,也可以在调制前对基带以低通滤波方式完成,两者的效果是相同的。在现代全数字调制解调器中,成形滤波器大都采用数字滤波器来实现。由于对基带信号进行数字滤波更为方便,因此成形滤波普遍采用基带数字滤波方案。-Shaping filter can be modulated by the modulation wave band-pass filtering is accomplished, it can before the modulation baseba
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:92498
    • 提供者:尤恺元
  1. OFDMFPGA

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  2. OFDM基带调制系统在FPGA上的实现,供数字信号处理专业参考-OFDM base-band modulation system in the FPGA on the realization of digital signal processing for professional reference
  3. 所属分类:DSP program

    • 发布日期:2017-05-06
    • 文件大小:1299968
    • 提供者:
  1. VHDL

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  2. PWM控制就是产生一定周期,占空比不同的方波信号,当占空比较大时,电机转速较高,否则电机转速较低。当采用FPGA产生PWM波形时,只需FPGA内部资源就可以实现,数字比较器的一端接设定值输出,另一端接线性递增计数器输出。当线性计数器的计数值小于设定值时输出低电平,当计数器大于设定值时输出高电平,这样就可通过改变设定值,产生占空比不同的方波信号,从而达到控制直流电机转速的目的。 直流电机控制电路主要由2部分组成,如图1所示:  FPGA中PWM脉宽调制信号产生电路; &
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:37426
    • 提供者:袁玉佳
  1. multifunctioninstrumentofhighfrequencysignalsbased

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  2. 两块STC89LE58RD+单片机以主从模式构成控制核心,行列式4*4键盘作为输入,OCMJ4*8C液晶作为显示,主机控制AD9854产生幅度可调、频率可调的正弦信号,同时实现数字调制功能,从机进行高速数据采集并与主机通讯,完成模拟调制功能。-the multifunction instrument of high frequency signals based on dds
  3. 所属分类:SCM

    • 发布日期:2017-04-02
    • 文件大小:367015
    • 提供者:赵希林
  1. FPGACPLDMSK

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  2. 为了便于信号发射,提高信道利用率、发射功率效率以及改善通信质量,人们研制出各种通信信号的调制样式。尽管调制样式多种多样,但实质上调制不外乎用调制信号去控制载波的某一个(或几个)参数,使这个参数按照调制信号的规律而变化。调制信号可以分别“寄生”在已调信号的振幅、频率和相位中,相应的调制就是调幅、调频和调相这三大类熟知的调制方式。 MSK信号就是调频这一大类中的一种相位连续的移频键控。其主要特点是包络恒定,带外辐射小,实现较简单,可用于移动通信中的数字传输 -see up
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:247468
    • 提供者:张开
  1. tiaozhifangshidezidongshibie

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  2. 数字信号处理中的调制方式的自动识别的MATLAB程序-Digital signal processing modulation of the automatic recognition of the MATLAB program
  3. 所属分类:DSP program

    • 发布日期:2017-04-03
    • 文件大小:1826
    • 提供者:王猛
  1. DSP

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  2. DSP硬件论文集,包含22篇DSP相关论文,caj格式。都是花银子买来的。 DSP与点阵式LCD显示器的接口设计.caj DSP体系结构在提高实时信号处理方面的作用.caj DSP器件的原理及应用.caj DSP在机械设备故障诊断中的应用.caj DSP应用的结构和发展方向.caj DSP技术及其应用讲座(六)──数字通信用数字调制解调器中的DSP技.caj DSP技术及其应用讲座第7讲语音识别及其DSP实现.caj DSP技术及其应用讲座第三讲数字信号处理器的发
  3. 所属分类:DSP program

    • 发布日期:2017-04-09
    • 文件大小:1061276
    • 提供者:刘伟
  1. Study_on_Key_Technologies_of_n4-DQPSK_Modulation_a

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  2. 本文首先研究可4一DQPsK调制解调系统中调制部分的基本原理和各个模块的设计方案,重点研究成形滤波器和直接数字频率合成器 (DireetoigitalFrequeneySynihesis,简称DDS),并针对各个关键模块算法进行matlab设计仿真,展示仿真结果。其次,研究调制解调系统解调部分的基本原理和各个模块的设计方案,重点研究差分解调,数字下变频和位同步算法,也针对其各个关键模块进行算法的Matlab设计仿真。然后用Matlab对整个系统进行理论仿真,得出结论。在此基础 上,采用超高速
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:5458230
    • 提供者:cai
  1. fsk

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  2. 过零检测法设计了一种FSK数字解调器,实现了对FSK数字调制信号的解调,达到了解调的目的-Zero-crossing detection method designed a digital FSK demodulator is realized on the demodulation of FSK digital modulation signals, to understand the purpose of transfer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:633
    • 提供者:朱伟
  1. vhdlcoder

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  2. 本文件夹包含了16个VHDL 编程实例,仅供读者编程时学习参考。 一、四位可预置75MHz -BCD码(加/减)计数显示器(ADD-SUB)。 二、指示灯循环显示器(LED-CIRCLE) 三、七人表决器vote7 四、格雷码变换器graytobin 五、1位BCD码加法器bcdadder 六、四位全加器adder4 七、英语字母显示电路 alpher 八、74LS160计数器74ls160 九、可变步长加减计数器 multicount 十、可
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:59211
    • 提供者:李磊
  1. Code

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  2. 设计一个正弦信号发生器,使用凌阳公司的16位单片机SPCE061A作为中央控制器,结合DDS芯片AD9850,产生0~15MHz频率可调的正弦信号,正弦信号频率设定值可断电保存;使用宽频放大技术,在50Ω负载电阻上使1K~10MHz范围内的正弦信号输出电压幅度VP-P=6V±1V;产生载波频率可设定的FM和AM信号;调制信号为1KHz的正弦波,调制信号的产生采用DDS技术,由CPLD和Flash ROM加上DAC进行直接数字合成;二进制基带序列码由CPLD产生,在100KHz固定载波频率下进行数
  3. 所属分类:SCM

    • 发布日期:2017-04-01
    • 文件大小:29227
    • 提供者:王金
  1. CDD

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  2. 用于数字信号的联合差分解调程序,主要用于GMSK调制信号-Joint differential for digital signal demodulation process, mainly for GMSK modulated signals
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-06
    • 文件大小:754
    • 提供者:dst
  1. zhengxian

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  2. 实现了ASK,PSK,FSK调制信号产生的数字信号源-To achieve the ASK, PSK, FSK modulation signal generated by digital signal source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:18763
    • 提供者:sam.zhang
  1. digital-FM-radio-design-

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  2. 本设计是一个数字调频收音机,调频就是频率调制,所谓频率调制就是原来等幅恒频的高频信号的频率,随着调制信号(音频信号)的幅度变化而变化,调频收音机(FM Radio)就是接收这些频率调制的无线电信号,经过解调还原成原信号的电子设备。FM Radio电路一般主要由接收天线、振荡器、混频器、AGC(自动增益控制)、中频放大器、中频限幅器、中频滤波器、鉴频器、低频静噪电路、搜索调谐电路、信号检测电路及频率锁定环路、音频输出电路等组成。本设计就是用单片机控制集成了上述所有FM功能的专用芯片,设计一个数字
  3. 所属分类:SCM

    • 发布日期:2017-03-22
    • 文件大小:441386
    • 提供者:周涛
  1. MATLAB-and-verilog

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  2. 1 采用正弦波,方波进行同步调制,实现调制信号、已调信号、解调信号的波形、频谱以及解调器输入输出信噪比的关系。 2 采用Verilog语言编写有符号的五位乘法器 3 实现数字与模拟调制-A sine wave, square wave synchronous modulation to achieve the modulation signal, the modulated signal, the demodulated signal waveform, spectrum and sig
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:558995
    • 提供者:许学真
  1. if-receiver

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  2. 中频数字接收机设计与实现 对中频数字接收机方案的可行性作了分析,并通过系统仿真工具SystemView对A/D,数字下变频(DDC)及AM、FM等调制信号的软件解调作了仿真。-Design and implementation of a digital intermediate frequency receiver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2050579
    • 提供者:ldd
  1. AM-tiaozhi-jietiao

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  2. 调制:将各种数字基带信号转换成适于信道传输的数字调制信号(已调信号或频带信号)。解调:在接收端将收到的数字频带信号还原成数字基带信号. 调制就是将基带信号的频谱搬移到信道通带中或者其中的某个频段上的过程,而解调是将信道中来的频带信号恢复为基带信号的反过程.-Modulation: converts various digital baseband signal to channel suitable for transmission of digital modulation signal (m
  3. 所属分类:DSP program

    • 发布日期:2017-05-24
    • 文件大小:7854287
    • 提供者:邹璐志
  1. 16qam

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  2. 一个16QAM数字调制电路,包括时钟生成电路,m伪随机序列生成电路,串并转换电路,电平映射电路、载波信号发生电路、ASK幅度调制电路及加法器(A 16QAM digital modulation circuit, including clock generation circuit, m pseudo-random sequence generation circuit, serial parallel conversion circuit, level mapping circuit, car
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2020-10-19
    • 文件大小:2685952
    • 提供者:独行的云
  1. AM调制解调

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  2. 基于Artix-7 FPGA的AM调制解调代码,从AD读入信号后,进行AM调制,并解调输出(将代码分成两个工程就是AM的调制和解调),其中解调用到的数字滤波采用MATLAB设计(The AM modulation and demodulation code based on artix-7 FPGA, after reading the signal from AD, carries out AM modulation, and demodulates the output (the code
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2021-04-20
    • 文件大小:41027584
    • 提供者:Emmanuel000
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