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数字钟实验(基于c51)
- 这是一个用c51做的数字钟源代码,实现了时间设置,闹铃设置等一系列钟表的功能,并付上了硬件原理图,供大家学习和参考,我的qq:9577287-This is a decoder to do with the number of Zhong Yuan code and realized the time settings, Alarms set up a series of watches function and pay its hardware schematics, for all lear
多功能数字钟设计
- 我做课程设计时候所设计出的数字钟电路，实现分、秒计时，异步复位、暂停功能，已经在板子上面实现。和大家分享，一起进步！
数字钟
- veriloge hdl 编写的一个数字钟 实现调时，调分，调秒，数码管显示时钟的功能
vhdl_clock.rar
- VHDL数字钟设计程序 设计要求 基本要求： 1、24小时计数显示； 2、具有校时功能（时，分） ； 附加要求： 1、实现闹钟功能（定时，闹响）；,VHDL digital clock design process design requirements for the basic requirements: 1,24 hours count display 2, with a school function (hours, minutes) additio
EDA
- 数字钟的实现 FPGA上运行 VHDL编写-Digital clock running on the FPGA to achieve the preparation of VHDL
shuzizhong
- 设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟，并具有定时与闹钟功能，能在设定的时间发出闹铃音，能非常方便地对小时、分钟和秒进行手动调节以校准时间，每逢整点，产生报时音报时。 实验平台： 1. 一台PC机； 2. MAX+PLUSII10.1。 Verilog HDL语言实现,还有完整的实验报告-The design of a can be hours, minutes, seconds time of 12 hours or 24 hours system, d
shzi
- 数字钟的单片机实现，有详细的源码及解释 算法结构清晰，对单片机学习者非常有用 对于电子专业的，拿来当课程设计也是相当不错的 功能有： 1，完成秒／分／时的依次显示并正确计数； 2，秒／分／时各段个位满10正确进位，秒／分能做到满60向前进位； 3，定时闹钟：实现整点报时，有扬声器发出报时声音； 4，时间设置，也就是手动调时功能：当认为时钟不准确时，可以分别对分／时钟进行调整； 5，可以清零；完成暂停；可以随时记时、暂停后记录数据。-The single-chip
multifunctionaldigitalclock
- 本设计采用一块单片机（AT89S52）作为多功能数字钟的控制核心，加以温度传感器、红外接收管、蜂鸣器、液晶显示器（LCD1602）、电源电路及其他电路构成。实现了时间设置、闹铃设置、闹铃开和关的功能；LCD显示小时、分钟，有AM、PM指示灯，闹钟就绪灯，闹钟到点蜂鸣器报警，220V供电基本功能。另外，本设计还实现了通过切换键盘显示现场温度，红外停止闹铃的功能。 -This design uses a single chip (AT89S52) as the core controller o
locker_with_LCD_and_clock
- 本程序用到4x4按键中断扫描法，用lcd显示，开机时候显示一个数字钟（时间不可设，稍后加入该功能），钟正常走 如果按下开锁键，进入以请输入密码界面，输入密码，如果密码正确，显示欢迎使用，密码错误蜂鸣器报警 且LCD显示密码错误，请重新输入。 注：数字时钟用的是DS1302实现，由于本人也才学单片机一个多月，所以注释非常详细，初学者很容易看懂。-This procedure used key interrupt scanning 4x4, with lcd display, bo
clock
- 用VHDL实现的完整数字钟代码，时分秒计时、校时、整点仿电台报时。-Used to achieve a complete VHDL code digital clock, accurate time at school, the whole point of imitation time radio.
shuzizhong
- 基于vhdl的数字钟完整工程文件，已在实验箱上实现-vhdl clock
AT89S51_product
- 单片机 数字钟 交通灯 led 报警产生器等许多功能的实现，还有很多-clock alert and so many product
deCPLDVHDLshijong
- 基于CPLD的VHDL语言数字钟（含秒表）设计 利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。 本设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VHDL语言输入—各模块程序设计）实现数字钟的设计、下载和调试。 -CPLD based on the VHDL language di
SHUZIZHONGVHDL
- 多功能数字钟的VHDL编程实现，有与其他数字钟不同的秒表，闹钟等更多功能-Multi-function digital clock of VHDL programming, digital clock with other different stopwatch, alarm clock function, such as more
clock
- 该数字钟实现时钟运行，调整，倒计时，秒表功能，且精确度经调试一天的误差在2S内-The digital clock to achieve the clock running, adjustment, countdown, stopwatch function, and the accuracy of the error by testing one day with the 2S
DZZ1
- 多功能数字钟 能进行正常的时、分、秒计时功能, 分别由6个数码管显示24小时、60分钟、60秒钟的计数器显示。 2. 能利用实验系统上的按键实现“校时”“校分”功能： 3. 能利用扬声器做整点报时-VHDL
clock1
- 多功能数字钟实现闹铃，整点报时，校时，仿广播电台报时功能-multifuntional digital clock written in verilog
数字钟修改版
- //1、数码管显示目前时间； //2、实现五个按键操作控制； //3、复位后内定数码管显示时间为00：00：00-1；(Digital clock realized by 51 single chip microcomputer)
数字钟设计
- 能够利用pfga实现简易的数字钟，有计时、复位、调时间等功能。(A simple digital clock can be realized by using PFGA.)
lcd数字钟
- 实现LCD显示数字钟日历，并且可以进行调对(Implement LCD display digital clock calendar)