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搜索资源列表

  1. embbeddsp

    1下载:
  2. 新买的书,完整打包。第二章,最小硬件系统设计及调试 第三章CCS工具及代码优化 第四章集成外设及DSP/BIOS应用实例 第5章软件无线电接收机设计实例 第6章实时语音信号处理系统设计实例 第7章 实时在线仿真系统设计实例 第8章 图像采集系统设计实例 第9章 便捷的系统升级模块实例 第10章 移动电话设计实例-buy new books, complete package. The second chapter, the minimum hardware system design and d
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:7683730
    • 提供者:大灰熊
  1. ccp

    1下载:
  2. ccp单片机ccp模块功能源代码。打包下载。
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:17737
    • 提供者:郭明
  1. adder.rar

    0下载:
  2. 一位全加器可由两个一位半加器与一个或门构成,该设计利用层次结构描述法,首先设计半加器电路,将其打包为半加器模块;然后在顶层调用半加器模块组成全加器电路,A full adder can be two a half-adder and an OR gate structure, the design is the use of hierarchical descr iption method, first of all the design half-adder circuit, be packa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:158202
    • 提供者:哈哈
  1. iec-61850 资料

    4下载:
  2. 学习61850过程中网上的一些资料..今天整理了一下,打包共享 86中MMS映射分析及其编码_解码模块的设计.pdf 61850-9-2报文格式.doc 61850软件设计说明书.doc Communication protocols.ppt IEC 61850入门.ppt 从二维表到树-IEC 61850完全解构.ppt 基于IEC61850的变电站过程总线通信的研究.nh 南方电网IEC61850技术培训.ppt 应用IEC61850通信
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2012-10-18
    • 文件大小:13004682
    • 提供者:xiaole
  1. USARTmonichengxu

    0下载:
  2. pic18f芯片的USART串口通讯模块的利用,程序实现了串口的初始化、接收与发送中断及数据的解包打包和发送过程。-pic18f chip USART serial communication module to use, the program achieved a serial port initialization, receiving and sending interrupts and data packing and sending the process of unpacking.
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-03-29
    • 文件大小:2168
    • 提供者:菜丫
  1. DDS_verilog

    0下载:
  2. 通讯中常用的dds模块的verilog源码打包下载-Communications commonly used in dds module verilog source code package to download
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:609765
    • 提供者:sofia
  1. wodechengxu

    0下载:
  2. 自己这个暑假做的一些小模块代码,给有需要的参考下,都是TXT格式的,都打包了。-Themselves this summer to do some small module code, there is a need to refer to, are in TXT format.
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:11924
    • 提供者:姚新峰
  1. fulladder

    0下载:
  2. 由数字电路知识可知,一位全加器可由两个一位半加器与一个或门构成,其原理图如图1所示。该设计利用层次结构描述法,首先设计半加器电路,将其打包为半加器模块;然后在顶层调用半加器模块组成全加器电路;最后将全加器电路编译下载到实验箱,其中ain,bin,cin信号可采用实验箱上SW0,SW1,SW2键作为输入,并将输入的信号连接到红色LED管LEDR0,LEDR1,LEDR2上便于观察,sum,cout信号采用绿色发光二极管LEDG0,LEDG1来显示。 图1.1 全加器原理图-it s a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:2314
    • 提供者:qingguozhi
  1. GPS_msp430_code

    0下载:
  2. 430单片机,程序的功能是通过串口0以4800,n,8,1的通行格式接收GPS数据,之后将 数据进行解析再通过串口1以4800,n,8,1的通行格式发送到PC机,其中数 据打包发送格式为GPS_DATA_PACKAGE:经度,纬度,速度,航向,水平高度, 海拔高度,卫星,年/月/日,时-分-秒(实际连调时这个数据包由GSM模块直 接发送到后台,在由后台再进行处理得到预期的效果)-The functions of the program through the serial por
  3. 所属分类:SCM

    • 发布日期:2017-11-23
    • 文件大小:43093
    • 提供者:wangda
  1. nRF24L01_C51

    0下载:
  2. 52单片机实现nRF24L01模块的简单无线通讯,代码及工程文件全部打包奉上,移植只需要修改相关接口定义,更换显示外设。调试通过,简单可靠,后边将继续更新相关开发。-52 microcontroller nRF24L01 simple wireless communication module, code and the project file all packaging and transplant only need to modify the relevant interface def
  3. 所属分类:SCM

    • 发布日期:2017-05-01
    • 文件大小:936022
    • 提供者:sevenjul
  1. etpu_set1

    0下载:
  2. 飞思卡尔单片机的etpu功能模块set1 打包好的 直接可以用-The etpu function module of Freescale MCU Set1 Carle pack can be used directly
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-02
    • 文件大小:188689
    • 提供者:李晓鹏
  1. Send_data

    0下载:
  2. 实现了将串口的数据,根据要求打包成以太网数据包,通过MII口发送。模块使用方便,直接调用。-Implements the serial data, packaged in accordance with the requirements into Ethernet packets, sent through the MII port. Module is easy to use, direct calls.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-14
    • 文件大小:5401
    • 提供者:quan
  1. Four-binary-adder

    0下载:
  2. 熟悉 VHDL 语言的模块化设计,了解元件例化和打包调用语句。用 VHDL 语言设计一半加器电路,然后用元件例化(COMPONENT)语句调用两个半加器电路,用结构描述实现一个全加器。-The modular design of VHDL language familiar to understand the components and packing cases call statement. Design using VHDL half-adder circuit, and then us
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3455701
    • 提供者:YCZ
  1. key_alone

    0下载:
  2. 4x4矩阵键盘扫描 去抖动 带编码输出 模块打包-the program of key scan
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1813776
    • 提供者:liujiali
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