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  1. jiyuxianxfzmdymqyj

    0下载:
  2. 基于VHDL的线性分组码编译码器设计-jiyuVHDLdexianxinfzm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:209295
    • 提供者:吴崇禧
  1. code(opp)

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  2. vhdl语言实现线性分组码的编码以及解码-vhdl language of linear block code encoding and decoding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1105
    • 提供者:kid
  1. linear-code

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  2. 线性分组码的matlab 源程序 线性分组码的verilog源程序-linear code matlab/verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:3310
    • 提供者:周天
  1. 7-4-linear-space-time-block-codes-

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  2. 7-4线性分组码编码器 vhdl描述-7-4 linear space-time block codes encoder vhdl derect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:185793
    • 提供者:郭少华
  1. fpga

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  2. 线性分组码的FPGA仿真与实现。欢迎分享,分享快乐。-The FPGA simulation and realization of the linear block code.Welcome to share, share the happiness.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:15578
    • 提供者:风弦
  1. linear

    0下载:
  2. 线性分组码编码电路和译码电路实现程序,仿真测试文件-Controls, coding, simulation test file linear block code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1389
    • 提供者:任一涵
  1. Verilog的135个经典设计实例

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  2. Verilog的135个经典设计实例,部分摘录如下:【例 9.23】可变模加法/减法计数器【例 11.7】自动售饮料机【例 11.6】“梁祝”乐曲演奏电路【例 11.5】交通灯控制器【例 11.2】4 位数字频率计控制模块【例 11.1】数字跑表【例 9.26】256×16 RAM 块【例 9.27】4 位串并转换器【例 11.8】多功能数字钟【例 11.9】电话计费器程序【例 12.13】CRC 编码【例 12.12】(7,4)循环码纠错译码器【例 12.10】(7,4)线性分组码译码器【例
  3. 所属分类:VHDL/FPGA/Verilog

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