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搜索资源列表

  1. asynchronoussignal

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  2. 描述跨时钟域分析,分析和解决异步时钟同步设计问题.-Descr iption of cross-clock domain analysis, analyze and solve design problems in asynchronous clock synchronization.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:478138
    • 提供者:张然峰
  1. multiclock_whitepaper

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  2. ASIC中多时钟域处理方法白皮书。描述了ASIC设计/FPGA设计中跨时钟域信号的处理方法。-ASIC in the multi-clock domain approach the White Paper. Describes the ASIC design/FPGA design in the inter-clock domain signal processing methods.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:273063
    • 提供者:forrest1
  1. CrossClockDomain

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  2. 跨时钟域设计不错的设计,进过modelsim仿真通过。-Cross-clock domain design is good design been to modelsim simulation through.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1372
    • 提供者:松鼠
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