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搜索资源列表

  1. first4

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  2. 4人抢答器的硬件描述语言设计,可以下载测试与仿真,通过EDA开发系统进行调试-four Responder hardware descr iption language design, test and can be downloaded simulation, EDA through the development of system debugging
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:133985
    • 提供者:sunjiacun
  1. VHDL学习的好资料--18个VHDL实验源代码

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  2. 20个VHDL实验源代码,包括: 1 交通灯控制器 2 格雷码变换器 3 BCD码加法器 4 四位全加器 5 四人抢答器 6 4位并行乘法器 9 步长可变加减计数器 10 可控脉冲发生器 11 正负脉宽数控信源 12 序列检测器 13 4位流水乘法器 14 出租车计费器 15 多功能数字钟 16 多功能数字秒表 17 频率计 18 七人表决器 19 数码锁 20 VGA彩条发生器
  3. 所属分类:VHDL编程

    • 发布日期:2009-04-26
    • 文件大小:16540
    • 提供者:qjhktk
  1. 用VHDL语言实现四人智力竞赛抢答器的设计

    0下载:
  2. 1、用feng模块将选手按下按键信号输出高电平给锁存模块lockb,进行锁存的同时发出aim信号实现声音提示,并使count模块进行答题时间的倒计时,在计满100妙后送出声音提示; 2、用ch41a模块将抢答结果转换为二进制数; 3、用sel模块产生数码管片选信号; 4、用ch42a模块将对应数码管片选信号,送出需要的显示信号; 5、用七段译码器dispa模块进行译码。
  3. 所属分类:VHDL编程

  1. qiangda

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  2. PROTEUS 仿真 4人抢答器 汇编语言编程 学校课程设计-PROTEUS device simulation Answer 4 Assembly Language Programming
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:41616
    • 提供者:JX
  1. 4answermachine

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  2. 4人抢答器的一个程序。。功能比较简单,希望对大家有帮助-Answer a procedural device. . Function is relatively simple, we want to help
  3. 所属分类:SCM

    • 发布日期:2017-04-07
    • 文件大小:9057
    • 提供者:刘蕾
  1. qdq

    0下载:
  2. (1)用于竞赛强大的四人抢答器 (2)抢答开始后20秒倒计,倒计结束后无人抢答显示超时 (3)能显示抢答台号 (4)系统复位后进入抢答状态,能显示犯规警报-(1) is used to contest a powerful four Responder (2) to answer in 20 seconds after the start of countdown, countdown display time-out after no one to answer in (3) ca
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:702854
    • 提供者:
  1. 444

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  2. 主持人如何启动抢答器。 2)选手用什么设备进行抢答。 3)如何判断哪位选手最先抢答。 4)如何显示抢答结果。 5)当有一人抢答,如何使得其他按钮按下无效。 6)当无人抢答时,怎样判断抢答结束,且如何实现结束后再次按抢答纽无效。 7)怎样再次进行新一轮的抢答 -Host How to Start Responder. 2) What equipment is available to answer in athletes. 3) How to determine whi
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-08
    • 文件大小:102776
    • 提供者:朱亚楠
  1. snag

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  2. 4人抢答器的VHDL源代码.当设计文件加载到目标器件后,按下核心板复位按键,表示开始抢答。然后,同时按下S1-S4,首先按下的键的键值被数码管显示出来,对应的LED灯被点亮。与此同时,其它按键失去抢答作用。-4 Responder of the VHDL source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:742
    • 提供者:王唐小菲
  1. qiangdaqi-EDA

    0下载:
  2. 智能抢答器的EDA实现: 1. 四人参赛每人一个按钮,主持人一个,按下就开始; 2. 每人一个发光二极管,抢中者灯亮; 3. 有人抢答时,喇叭响两秒; 4. 抢答时限10秒,从有人抢答开始记时,10秒内不回答问题时喇叭发出两秒声响 -Smart Responder of EDA to achieve: 1. Four entries per person of a button, a moderator, click on Start 2. Each a light-emi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:38938
    • 提供者:xiaoxiao
  1. vhdlcoder

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  2. 本文件夹包含了16个VHDL 编程实例,仅供读者编程时学习参考。 一、四位可预置75MHz -BCD码(加/减)计数显示器(ADD-SUB)。 二、指示灯循环显示器(LED-CIRCLE) 三、七人表决器vote7 四、格雷码变换器graytobin 五、1位BCD码加法器bcdadder 六、四位全加器adder4 七、英语字母显示电路 alpher 八、74LS160计数器74ls160 九、可变步长加减计数器 multicount 十、可
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:59211
    • 提供者:李磊
  1. TPQDQ

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  2. 基本要求: (1)通过功能切换开关设定为抢答功能,完成4人抢答功能,通过启动按键启动抢答,数码管显示抢答到计时,抢答成功后,到计时停止,蜂鸣器响,抢答成功的键盘对应的指示灯亮。 (2)通过功能切换开关设定为投票功能,完成4人对4候选人投票功能,通过启动按键启动表决,数码管显示投票倒计时, 4个LED指示灯闪烁,计时到零,4个LED指示灯灭,从1到4轮番显示表决结果,第一个数码管显示候选人编号,第二个数码管显示该候选人得票数。 扩展要求: (1)通过串行口将抢答信息、时间信息和投票
  3. 所属分类:SCM

    • 发布日期:2017-04-04
    • 文件大小:104667
    • 提供者:Gallen
  1. Four-Responder

    0下载:
  2. (1)设计用于竞赛抢答的四人抢答器; .有多路抢答,抢答台数为4; .具有抢答开始后20秒倒计时,20秒倒计时后无人抢答显示超时,并报警; .能显示超前抢答台号并显示犯规警报; (2) 系统复位后进入抢答状态,当有一路抢答按键按下,该路抢答信号将其余各路抢答信号封锁,同时铃声想起,直至该路按键松开,显示牌显示该路抢答台号; -(1) is designed to answer in the four competition Responder . More way to an
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:8949
    • 提供者:薛静
  1. 4ren-qiang-da-qi

    0下载:
  2. 4人抢答器(简单的4人抢答器 5S倒计时抢答 20s回答时间 )-failed to translate
  3. 所属分类:SCM

    • 发布日期:2017-11-25
    • 文件大小:21059
    • 提供者:王月
  1. shiyanqdq

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  2. 基于FPGA 实现的4人抢答器模块的基础源程序。-FPGA-based realization of four Responder module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:871130
    • 提供者:彭元杰
  1. qiangdaqi

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  2. 四人抢答器, 有4组抢答,系统开始后进入抢答状态,抢答开始后20秒倒计时,20秒倒计时后无人抢答显示超时,发出报警信号;当有一路抢答按键按下,该路抢答信号将其余各路抢答信号封锁,同时铃声响起,显示该路抢答台号;一轮结束后按复位键将所有状态复位。-Four Responder, Responder has four groups, the system begins to enter the answer in the state, began to answer in 20 seconds af
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:357405
    • 提供者:haby
  1. 4

    0下载:
  2. 4位抢答器,最先按键的人得到回答问题的机会-4 a buzzer, the first key people get the chance to answer the question
  3. 所属分类:SCM

    • 发布日期:2017-04-11
    • 文件大小:895
    • 提供者:吴剑豪
  1. RQDQ-4

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  2. 4人抢答器,计时器和抢答器综合,开始抢答时,计时器从20s开始倒计时,如果无人抢答,计时器到0时报警器响3s,有人抢答,数码管会显示第几人抢答。-4 hours of answering device, timer and answer device synthesis, began to answer, the timer 20s countdown, if no one answer, the timer to 0 when the alarm ring 3s, some people a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-14
    • 文件大小:3400084
    • 提供者:刘洋
  1. responder

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  2. basys2实现抢答器,Verilog描述语言,实现4人抢答器,功能已验证-Basys2 u5B9 u73B0 u62A2 u7B54 u5668 uFF0CVerilog u63CF u8FF0 u8BED u8A09 uFF0C u5B9E u73B04 u4EBA u62A2 u7B54 u5668 uFF0C u529F u80FD u5DF2 u9A8C u8BC1
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-16
    • 文件大小:1024
    • 提供者:
  1. 8人抢答器

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  2. 基于AT89C51单片机设计制作一个抢答器,具体要求如下: 1、 设计一个智力竞赛抢答器,可同时共8名选手参加比赛,编号为1、2、3、4、5、6、7、8,各用一个按键。 2、 用一个按键作为主持人总开关,用来控制系统的清零和抢答的开始。 3、 抢答器开始后,数码管开始10秒倒计时,若有选手按动抢答按钮,在LED数码管上显示选手的编号,同时灯亮且伴随声音提示;倒计时完成后,选手不能在抢答;有人抢答成功后,要禁止其他选手抢答;最先抢答选手的编号一直保留到主持人将系统清零。(Based on A
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2020-12-15
    • 文件大小:107520
    • 提供者:zaxqscwdv
  1. 抢答器

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  2. 四人抢答器的设计 具有主持人复位功能; 两个四人抢答器可直联成八人抢答器; 数字显示选手编号:单机使用时,显示1-4号选手;联机测量时,显示1-8号选手。(Design of four-person answering device Has a moderator reset function; Two four-person responders can be directly connected into an eight-person responder; The number shows
  3. 所属分类:嵌入式/单片机/硬件编程

    • 发布日期:2020-07-02
    • 文件大小:96256
    • 提供者:soader
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