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  1. dds_ise7.1_su

    2下载：
  2. 用Verilog语言实现信号发生器，包括AM，FM,PM，ASK,PSK,FSK调制。-using Verilog language signal generator, including AM, FM, PM, ASK, PSK, FSK modulation.

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：5426
    • 提供者：lee
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