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介绍了WinCE系统下BootLoader的开发基本过程
CE并不是一个通用的安装版操作系统，在形形色色的嵌入式硬件设备世界里， 一款CE系统通常只会针对某一种硬件平台生成。所以，作为原始设备生产商，必须根据自己的硬件平台和应用场合定制CE，最主要的工作就是编写适合于自己的板级支持包（BSP）。在BSP中，包含了一个重要的组成部分——BootLoader。创建一未功能完善的BootLoader，是开发WinCE系统的第一步，也是极为关键的一步。本文将结合开发实例，介绍如何开发适合于自己硬件的B
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论文讨论的是基于VHDL 实现在系统编程平衡GOLD 码逻辑电路设计，给
出周期与相位可编程平衡GOLD 码生成电路设计方案。该方案由最长线性移位寄存器
与可选反馈支路构成。-Discussion paper is based on VHDL programming to achieve a balance in the system logic circuit design GOLD code given cycle and phase balance GOLD programmabl
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Abstract—In this paper a current reference generation
method for a voltage source shunt active power filter is
examined. The proposed method improves the harmonic
filtering by compensating the delays in the system. In
stationary operating poi
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本文中设计并实现了一个基于TI最新的DSP多媒体平台——Da Vinci平台的微波传输无线监控系统。介绍了新一代双核DSP平台的特性,阐述了基于双核系统的开发方法和流程。
-This paper the design and implementation of a new TI DSP-based multimedia platform- Da Vinci platform for microwave transmission wireless monitoring system. Int
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由于altera公司的CRC生成和校验模块不支持本系统使用的Cyclone IV E系列FPGA，因此本文独立设计了CRC模块。该模块的接口与altera公司的CRC模块接口基本一致，能够对16位输入的数据流进行CRC校验码生成和校验。本文采用CRC-CCITT生成项，其表达式为：X16+X12+X5+X0。本模块需要startp信号及endp信号指示数据传输的起始及结束。本模块采用状态机设计，对于数据头和数据尾分别由不同的状态来处理。在本模块中，使用了for循环，这会消耗较多的FPGA资源，但
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本文研究了基于Matlab/Simulink的DSP代码生成的方法。介绍了基于Matlab/Simulink的DSP系统级设计方法、Matlab与CCS系统对于DSP的各自特点及相互连接，论述了面向TI DSP芯片的系统设计。传统的DSP设计开发流程分为开发设计和产品实现两个环节。这样的开发流程存在许多问题，基于Matlab/Simulink的系统级设计方法，完成了从概念设计、软件仿真、硬件测试全过程。在软件算法仿真测试后直接生成面向数字信号处理（DSP）芯片的代码，有利发现系统设计的错误。-I
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Research towards meeting the higher demands for
higher data rates was the main reason for the birth of an
evolution technology towards the 4th generation mobile
communication systems. This evolution to the current 3rd
generation UMTS systems
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This paper proposes a Flexible D-STATCOM (Distribution STATIC Compensator) and its new
controller system, in IEEE 13-bus industrial distribution system, that be able to both mitigate all types of series
faults (open-circuit or open conductor faults
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