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当前位置: 首页 资源下载 源码下载 嵌入式/单片机编程 搜索资源 - RS vhdl code

搜索资源列表

  1. maxshiyan

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  2. 大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟,数码显示,74ls138,8,4位计数器,d,rs触发器,加法器,交通灯等,此原码基于长江大学可编程器件实验箱,如要运行在其他平台上需要重新定义管脚-University VHDL language experiment Daquan, based on the max-plus2 platform within 8-3 decoder, 8 Adder, digital clock, digital d
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:865899
    • 提供者:田晶昌
  1. uart_transmitter

    0下载:
  2. Very good info. for RS-232 transmitter VHDL code .
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1154
    • 提供者:wan mi
  1. uart_receiver

    0下载:
  2. Very good info. for RS-232 receive VHDL code .
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1440
    • 提供者:wan mi
  1. ECHO_DE2

    0下载:
  2. Very good info. for RS-232 echo VHDL code .
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2074
    • 提供者:wan mi
  1. RS-code

    0下载:
  2. 我测试过的!Verilog HDL实现RS编码。-I' ve tested it! RS coding Verilog HDL implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:982874
    • 提供者:kiekie
  1. RS485EN

    0下载:
  2. RS485的双向通信处,正在为此头疼的同学们可要注意了,这个可以解决你们双向通信过程中的很多问题哦-Two-way RS485 communications, the headache is to this end they' ll pay attention to the students, this two-way communication you can solve many problems in the course of oh
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:151216
    • 提供者:江山
  1. rs-codec-8-16

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  2. RS[255,223]纠错码verilog源码,包含编码和解码模块,以及testbench等。-Verilog source code for RS[255,223] encoder and decoder, with testbench included.
  3. 所属分类:VHDL编程

    • 发布日期:2013-05-13
    • 文件大小:27523
    • 提供者:饶进平
  1. RS

    0下载:
  2. reed selemon encoder vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:77355
    • 提供者:mohamed saad
  1. RSverilog

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  2. RS译码主要模块的verilog代码,很有用也很实用的,需要的一定要看哦-RS decoding main modules of the verilog code, very useful and very useful, and we need to look at Oh sure
  3. 所属分类:SCM

    • 发布日期:2017-03-26
    • 文件大小:9018
    • 提供者:gx
  1. RS-5-3-CODE

    0下载:
  2. RS(5,3)编码器原程序 程序已经调试过 且比较简短-RS(5,3) coder ,this code is very short
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:465414
    • 提供者:ai锋聆
  1. RS

    0下载:
  2. RS编码器的VHDL源程序,程序有点大,不过能用。-RS encoder VHDL source code, program a little big, but can be used.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:896948
    • 提供者:lcz
  1. RS

    0下载:
  2. 基于FPGA的RS编码,包括RS码的编码原理,RS电路的设计与实现-FPGA-based RS code, including the RS, the coding principle, RS Circuit Design and Implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1132618
    • 提供者:陈凯
  1. RS

    0下载:
  2. RS译码器的设计,使用RS码设计的译码器-RS decoder design, the use of RS code decoder design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:12402
    • 提供者:许皓天
  1. working_code

    0下载:
  2. rs 485 working code for project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:4254
    • 提供者:sandhya
  1. Trigger

    0下载:
  2. 各类触发器VHDL源码程序,在quartus-ii7.2版本上测试通过,文件中包括D触发器,JK触发器,RS触发器,T触发器。-Various triggers VHDL source code program in quartus-ii7.2 version of the test is passed, the document includes a D flip-flop, JK flip-flop, RS flip-flop, T flip-flop.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:925932
    • 提供者:baoguocheng
  1. rs232

    0下载:
  2. this is vhdl code. purpose of rs-232 connected with altera cyclone2.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:94436
    • 提供者:kimjuhyun
  1. rs422

    1下载:
  2. RS-422的VHDL实现,代码测试能用-RS-422 VHDL implementation code test can be used
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-02
    • 文件大小:991232
    • 提供者:PETER
  1. 82be270ea751

    1下载:
  2. RS(255,239)编码器的VHDL语言源代码,希望能对大家有一定帮助-the code of the encoder of rs(255,239),hope can help you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:4047
    • 提供者:周达
  1. (255_223)-RS-decoder

    0下载:
  2. 使用VHDL实现(255,233)的RS硬件译码器,详细地介绍了(255,223)RS码硬件译码器的实现流程,并且分析了影响处理速率提高的瓶颈因素,采用RiBM算法实现译码-Use VHDL (255,233) RS hardware decoder, a detailed descr iption of the (255,223) RS code hardware decoder implementation process, and analyze the bottleneck factor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:196424
    • 提供者:vb
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