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搜索资源列表

  1. Viterbi_v

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  2. Viterbi算法的Verilog源代码。-Viterbi Algorithm Verilog source code.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:11091
    • 提供者:qjyong
  1. viterbidecoder

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  2. 提供实现了(2,1,7)卷积码的维特比译码的源程序,采用了最大似然算法,介绍了软判决维特比译码算法过程的三个步骤:初始化、度量更新和回溯译码。-for achieving a (2,1,7) Convolutional Codes Viterbi decoding of the source, using the maximum - likelihood algorithm, introduced a soft-decision Viterbi decoding algorithm of the
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:1261
    • 提供者:王雪松
  1. viterbi

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  2. verilog程序,实现了(2,1,4)卷积码编码,和基于回溯算法的维特比译码器-verilog program to achieve the (2,1,4) convolutional code encoding, and algorithm based on the back of the Viterbi decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:2881
    • 提供者:xiongherui
  1. TELECOM2

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  2. This file contains program files associated with the paper titled "US Digital Cellular Error-Correction Coding Algorithm Implementation on the TMS320C5x", Telecom Applications With The TMS320C5x DSPs, Application Book, 1994, SPRA033. This file c
  3. 所属分类:DSP program

    • 发布日期:2017-03-29
    • 文件大小:19384
    • 提供者:MuckChow
  1. 20080923

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  2. This is nice paper on soft output viterbi error correcting algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:171566
    • 提供者:shubh
  1. viterbi

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  2. 对于语音信号的Viterbi算法的简单仿真实现 在QuartusII下-Viterbi algorithm for speech signals simple simulation to achieve in the next QuartusII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:684
    • 提供者:房先生
  1. Viterbi

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  2. The Viterbi algorithm is a dynamic programming algorithm for finding the most likely sequence of hidden states – called the Viterbi path – that results in a sequence of observed events, especially in the context of Markov information sources, and mor
  3. 所属分类:SCM

    • 发布日期:2017-03-29
    • 文件大小:2267
    • 提供者:Lee Sangmin
  1. FPGAOFDM

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  2. 频偏校正算法的FPGA实现源码,相信对大家很有帮助。-Viterbi algorithm for FPGA implementation source code, I believe very helpful to everyone.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3771444
    • 提供者:王强
  1. Design-Space-Exploration-of-Hard-Decision-Viterbi

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  2. Space Exploration of Hard-Decision Viterbi Decoding: Algorithm and VLSI Implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1087292
    • 提供者:saravanan
  1. tvitt2_bytecch

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  2. 此源码为在DSP上实现的卷积纠错编解码算法,,解码使用维特比VITEBI算法 可直接使用。 -The source for the convolution error correction encoding and decoding algorithms on the DSP, decoding using the Viterbi than VITEBI algorithm can be used directly.
  3. 所属分类:DSP program

    • 发布日期:2017-04-16
    • 文件大小:75338
    • 提供者:
  1. The-viterbi-algorithm-(1)

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  2. Vetrbi decoder VHDL code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:389787
    • 提供者:rajaisking
  1. vhcg_latest.tar

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  2. Viterbi algorithm is the most likelihood decode algorithm of convolution code. Viterbi decoder means the VLSI implementation of Viterbi algorithm. In the area of communication, convolution code is very popular, so how to improve the performance a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:654009
    • 提供者:phani
  1. conv_dencode

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  2. 基于quartus软件的卷积译码算法,应用维特比译码算法完成-Convolutional decoding algorithm based on the quartus software.complete the application of viterbi decoding algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-08
    • 文件大小:947198
    • 提供者:宏伟
  1. acs

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  2. This an ACS unit which can be used in log-map algorithm as well as viterbi algorithm-This is an ACS unit which can be used in log-map algorithm as well as viterbi algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1470549
    • 提供者:arulananthan
  1. handbook

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  2. Abstract—This paper presents a Viterbi-based test compression algorithm/architecture that provides high encoding efficiency and scalability with respect to the number of test channels. The proposed scheme finds a set of compressed test vectors
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3824049
    • 提供者:shankar.m
  1. viterbi_decode_veeren

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  2. Viterbi decoding algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2854
    • 提供者:hr
  1. Viterbi_algorithm_VeeRen

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  2. Viterbi algorithm using Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:76989
    • 提供者:hr
  1. verilog-juanjima

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  2. 卷积码是一种重要的前向纠错信道编码方式,其纠错性能常常优于分组码,且(2,1,7)卷积码已应用于现代卫星通信系统中。Viterbi译码算法能最大限度地发挥卷积码的优异性能。这里采用Verilog  HDL语言设计出(2,1,7)卷积码的编码器模块和基于Viterbi算法的译码器模块,译码器采用全并行结构,译码速度快-Convolutional code is an important forward error correction channel coding method, and
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:10240
    • 提供者:邓博于、
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