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搜索资源列表

  1. AlteraCycloneIIFPGAStarterBoard

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  2. Altera Cyclone II FPGA Starter Board原理图-Altera Cyclone II FPGA Starter Board Schematic

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-01
    • 文件大小：236298
    • 提供者：王辉

  1. DDR_CTRL

    0下载：
  2. DDR Verilog 控制器，quartus 10.1工程。适用Altera Cyclone® III starter board-DDR control quatrus 10.1，Altera Cyclone® III starter board

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-29
    • 文件大小：516898
    • 提供者：Enjob

  1. RGMII_TRANSMITTER

    0下载：
  2. This module converts 8 bit SDR flow to 4 bit DDR RGMII flow, proved on Altera Cyclone 3 devices.

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-01-09
    • 文件大小：2045952
    • 提供者：serg_86

  1. RGMII_RECEIVER

    0下载：
  2. This module converts 4 bit DDR RGMII flow to 8 bit SDR flow, proved on Altera Cyclone 3 devices.

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-18
    • 文件大小：2027520
    • 提供者：serg_86
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