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  1. w11_latest[1].tar

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  2. 该项目包含一个完整的PDP - 11系统:一个内存管理单元七十○分之十一的CPU,但没有浮点单元,一组基本的单总线外围设备(DL11,LP11,PC11,RK11/RK05),以及最后但并非最不重要的一用于SRAM和PSRAM高速缓存和内存控制器。该设计的FPGA验证,目前运行Digilent的S3BOARD和NEXYS2板和靴子第5版的UNIX和2.11BSD UNIX操作系统。-The project contains a complete PDP-11 system: a 11/70 CP
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-02
    • 文件大小:714582
    • 提供者:zhaohaiting
  1. IO_controll

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  2. this a controller, mainly for the nexys2 board based around the spartan 3E fpga from xilinx. controlls various outputs and inputs.-this is a controller, mainly for the nexys2 board based around the spartan 3E fpga from xilinx. controlls various outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:724
    • 提供者:safe_cpu
  1. logic-(3)

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  2. Bluetooth connection between a pc and a Spartan 6 PModBT module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:9026
    • 提供者:joshua
  1. lab2

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  2. xilinx官网edk实验,lab2,用nexys 2 板实验源代码-xilinx edk official website experiments, lab2, with nexys 2 plate test source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5140754
    • 提供者:youzhiliu
  1. Nexys2_sch

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  2. digilent最新fpga开发板nexys原理图资料,非常详细,规范。-digilent latest fpga development board nexys schematic information, very detailed, specification.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1721721
    • 提供者:tiger
  1. SD_GCC_V2.3_M32

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  2. sd file system for the nexys2 fpga board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:132409
    • 提供者:reconfigurer
  1. dd

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  2. 本系统由FPGA构建,使用Nexys2(120万门)开发板。在VGA接口显示器上绘制图形,分辨率1024x768,绘图部分基于硬件,有画点、画线、画矩形、字符功能。使用32位处理器产生使用应绘制的内容,使用PSRAM作为显示存储器。可以以很高的刷新率绘制各种图形,具有很高的应用价值。-The system built by the FPGA of Nexys2 (120 million gates) development board. VGA connector on the monitor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:58361
    • 提供者:wen
  1. doorlock.rar

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  2. 门锁 状态机 verilog 适用于digilent NEXYS2开发板,doorlock state machine verilog applied to digilent NEXYS2 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:2189
    • 提供者:占建
  1. 7segment-display-VHDL

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  2. 使用的NEXYS2原型设计电路板的7段编码器模拟-using the NEXYS 2 prototyping board Simulate the 7-segment encoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:170356
    • 提供者:Li Chen
  1. Control_Display

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  2. Controlador de display siete segmentos en verilog El archivo contiene selector decodificador multiplexor y archivo para simulacion Sevent segment dispay controler in verilog for basys nexys2 nexys3 fpga boards This file have a decoder, selector
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:3155
    • 提供者:megasdra
  1. ReactionTimer

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  2. Reaction Timer verilog code, can be downloaded on texas NEXYS2 or NEXYS3 board to test the reaction time by pressing the buttons.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:2563
    • 提供者:WPI
  1. leds

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  2. leds, vhdl spartan 3 nexys2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:5269
    • 提供者:yassinechebbi
  1. ADC

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  2. verilog At the last, before starting fist go through the FPGA NEXYS2 Board manual. It will be useful for you for this interfacing and also for the future. Best of luck…, try this one because practice makes man perfect. And, yes also if you have a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2188
    • 提供者:sid
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