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  1. AD50

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  2. AD50C语音通信模块 该系统首先将模拟信号(实验时可以由信号发生器产生),经过一个或多个硬件滤波器,或其他的信号预处理,到达AD,结果AD转换成数字信号,传输到DSP,DSP对这个信号进行采集、处理、分析,如果有必要再经过DA,转换成模拟信号输出-AD50C voice communication module,The system first analog signals (experiment can be generated by the signal generator), thr
  3. 所属分类:SCM

    • 发布日期:2017-04-04
    • 文件大小:579577
    • 提供者:刘华
  1. FPGA-and-DSP-based-on-the-Bayer-format-image-pre-p

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  2. 在图像实时处理的过程中,下层图像预处理的数据量大,运算简单,但是要求运算速率高,可以用FPGA硬件来处理,上层所处理的数据量少,算法结构复杂,适于运算速度快,寻址灵活的DSP数字信号处理器进行处理。该系统充分发挥了FPGA和DSP各自的优势,能更好地提高图像处理的实时性,降低成本。 -Real-time processing in the image process, the lower the amount of data preprocessing, simple operation,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:97095
    • 提供者:汪江
  1. csxt

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  2. 基于单片机自行车测速系统;速度里程表由信号预处理电路、AT89C51单片机、数码管显示电路、串口数据存储电路和系统软件组成。-Velocity measurement system based on MCU bicycle speed odometer by the signal preprocessing circuit, AT89C51 microcontroller, digital display circuit, serial data storage circuit and sys
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:235808
    • 提供者:han
  1. dc_rmv

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  2. 这是一个用verilog写的DC滤波器,即melp算法中预处理部分,主要滤除50hz工频干扰,采用一个4阶的切比雪夫高通滤波器,截去频率位60hz以下的信号,其阻带的衰减位30db。-This is a verilog to write a DC filter the preprocessing part that melp algorithm, main filter 50hz frequency interference, the use of a fourth-order Chebyshe
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-13
    • 文件大小:4755746
    • 提供者:张妞妞
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