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Altera的IP源码8237
- 名鼎鼎的Synopsys公司出的8051IP Core VHDL语言编写，能被keilC51支持-renowned name of the company Synopsys 8051IP Core VHDL language, support can be keilC51
jtag_cpld_vhdl
- JTAG CPLD实现源代码，比用简单并口调试器快5倍以上。 以前总觉得简单的并口jtag板速度太慢，特别是调试bootloader的时候，简直难以忍受。最近没什么事情，于是补习了几天vhdl，用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是50秒左右。tck的频率还可以加倍，但是不太稳定，而且速度的瓶颈已经不在tck这里，而在通讯上面了。 -JTAG CPLD
embedded_avr_core
- 一个嵌入式微avr的vhdl源代码,.大家可以参考一下 -an embedded micro-avr vhdl the source code. We can take a look
ug_virtual_jtag_design_example 包含两的关于Virtual JTAG的应用实例
- 包含两的关于Virtual JTAG的应用实例，可以为Virtual JTAG操作提供借鉴。,Contains two Virtual JTAG on the application, can provide reference Virtual JTAG operation.
第1章－SD卡读写模块
- 第1章－SD卡读写模块 1. sdconfig.h: 该文件为SD卡读写模块配置头文件，用户可根据实际硬件条件进行修改. 2. SD目录 : SD卡读写模块的全部文件,一般不用修改. 3. 建议sdconfig.h文件不要放于SD目录中，因为SD目录中的文件一般无须修改,sdconfig.h通常会有改动. 4. 例子见上一级目录的SDExample目录.-Chapter 1-SD Card Reader module 1. Sdconfig.h : This
C05_IPCore8051
- 使用VHDL语言编写的8051IP核，可以嵌入到自己的设计中使用-The use of VHDL language 8051IP nuclear, can be embedded into the design of their own use
niossram
- altera fpga ep3c25器件微处理器开发，niosii+sram, 已编译通过，可直接下载到开发板-altera fpga ep3c25 the development of microprocessor devices, niosii+ sram, compiled through, can be directly downloaded to the development board
ug_virtual_jtag_design_example_2
- 包含两的关于Virtual JTAG的应用实例，可以为Virtual JTAG操作提供借鉴。-Contains two Virtual JTAG on the application, can provide reference Virtual JTAG operation.
mipssimple
- simple MIPS source code very simple it has not complete but you can test it
LED
- 在ALTERA的DE 2 开发板上做的一个类似闪烁的彩灯，用了16个LEDR，可以直接下载到板子上运行，基于经典的开发平台Quartus II+SOPC Builder+Nios II IDE 做的，只要看了以后，你就会自己设计各种花样的彩灯闪烁的样子了.所用语言有多种，VHDL,C/C++等-DE 2 in the development of the ALTERA board to do a similar flickering lantern, with a 16 LEDR, can be
8051_latest
- 8051ip核，可用于ic设计和FPGA的软ip核使用-8051ip nuclear, can be used for ic design and FPGA soft-core use of ip
scpu
- 一些零散而简单的CPU功能部件，一部分源码是放在TXT文件中，只要改成VHDL格式就可以使用。-Some scattered and simple CPU features, part of the source is placed in TXT file into VHDL format as long as you can use.