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搜索资源列表

  1. 相位差可调的双通道信号发生器的设计

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  2. 相位差可调的双通道信号发生器的设计,可以作为信号源用-phase difference adjustable dual-channel signal generator, we can use as a signal source
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:309523
    • 提供者:胡路听
  1. EXPT12_10_PHAS

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  2. 数字移相信号发生器设计,采用quartus2平台-digital phase shifting generator design platform using quartus2
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1281052
    • 提供者:zdf
  1. 8位可预置的循环移位数字信号发生器、简易逻辑分析仪

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  2. 简易逻辑分析仪的设计用源代码,为05年电子大赛2等奖作品-simple logic analyzer with the design of the source code for electronic 05 2 Prize Competition works
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:80105
    • 提供者:邓勇
  1. vhdl

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  2. vhdl的一些源代码,包括dds 设计,交通灯设计,信号发生器设计的一些源代码
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:71184
    • 提供者:马斌
  1. DDS.rar

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  2. 基于EPM7128的数字合成信号发生器(DDS)设计。通过对EPM7128编程,组合出地址累加器、数据锁存器、256*8位ROM空间。外接DA可实现正弦波输出功能,EPM7128-based signal generator for digital synthesis (DDS) design. EPM7128 through programming, the combination of address accumulator, data latches, 256* 8 ROM space.
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:353854
    • 提供者:xiaoyu
  1. signal_generator

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  2. 基于vhdl的多功能函数信号发生器的设计,能实现三角波、方波、正弦波。-VHDL-based multi-function signal generator design, can achieve the triangular wave, square wave, sine wave.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:784
    • 提供者:tony
  1. vhdldds0000

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  2. 采用fpga的hdl语言实现dds的信号发生器的设计,性能与传统相比明显提高。-Hdl language using FPGA implementation of the signal generator dds design, performance markedly improved compared with the traditional.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:172314
    • 提供者:李江
  1. DDS

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  2. 基于DDS原理的几种信号发生器的设计的几篇论文,使用FPGA平台或者FPGA和PC共同平台实现-DDS-based signal generator several principles of design, the use of FPGA or FPGA platform and a common platform PC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:592121
    • 提供者:王霄洲
  1. 3

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  2. 基于FPGA的任意信号发生器,毕业设计完整稿,适合做毕设的同学参考-FPGA-based arbitrary signal generator, a complete draft graduation project, suitable for students to complete reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:81653
    • 提供者:王男
  1. duobo

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  2. 使用dspbuilder中的宏模块设计多功能信号发生器,如正弦波,三角波,方波-Use dspbuilder macro module design multi-function signal generator, such as sine wave, triangle wave, square wave
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:514646
    • 提供者:cpuboy
  1. FPGApinlvji

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  2. 当年本科时的毕业设计,信号发生器和频率计-The time of the year undergraduate graduate design, signal generator and frequency counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:10384
    • 提供者:zhanglei
  1. basedondds

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  2. 基于DDS方式的信号发生器设计 -tHE WAVE based on DDS tHE WAVE based on DDS tHE WAVE based on DDS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:211137
    • 提供者:zhangyunchuan
  1. pinlvji

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  2. 测频控制信号发生器设计,防止可能产生的毛刺。这是老师给的实验程序,共享一下!-Design of frequency control signal generator, to prevent possible glitches. This is the teacher to the experimental procedures, share what!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:5213
    • 提供者:黄顺涛
  1. dds

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  2. 基于FPGA的DDS波形信号发生器,功能强大,代码规范,值得学习-FPGA-based DDS waveform signal generator, powerful, code specifications, it is worth learning
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2561345
    • 提供者:Andy Lao
  1. pwmtest2

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  2. PWM信号发生器,产生占空比、频率可控制的PWM信号,可进行步进电机细分驱动系统设计。用计数器、比较器等实现。-PWM signal generator to generate the duty cycle, frequency PWM control signal can be broken down stepper motor drive system design. With counters, comparators achieved.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:369176
    • 提供者:tanzhde
  1. SG_FPGA

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  2. 2006年电子设计竞赛二等奖,多功能函数、信号发生器核心器件FPGA内部的原理图,主要模块用VHDL代码描述,包括PLL、相位累加器、波形算法和正弦波查找表,可实现0.005Hz~20MHz的多波形信号产生,频率步进值0.005,输出接100MSPS速率的DAC--AD9762-Electronic Design Competition 2006, second prize, multi-function signal generator within the core of the devic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1099880
    • 提供者:zlz
  1. EWB-sequence-11000011generator

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  2. 使用Electronics Workbench 5.0电子仿真软件(EWB)设计的序列信号发生器。-Using electronic simulation software Electronics Workbench 5.0 (EWB)design a sequence signal generator.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:8068
    • 提供者:ultimat
  1. dds(1)

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  2. 基于DDS的信号发生器设计。DDS,FPGA,Verilog。(Design of signal generator based on DDS.DDS,FPGA,Verilog.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-23
    • 文件大小:11024384
    • 提供者:电磁驱动
  1. 基于FPGA的多路同步脉冲发生器设计1

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  2. 采用FPGA(现场可编程门序列)编写VHDL语言设计多路同步脉冲发生器,对信号进行分频处理,实现四路信号相位相差T/16和T/8的延迟相位输出,实现的四路脉冲与传统的脉冲同步器不同,它具有高集成度,高通用性,容易调整和高可靠性等特点。(Using FPGA (field programmable gate sequence) to write VHDL language to design multi-channel synchronous pulse generator, to divide
  3. 所属分类:VHDL/FPGA/Verilog

  1. 数字基带信号的传输码型发生器设计实验报告

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  2. vhdl语言,数字基带信号的传输码型发生器设计,附代码
  3. 所属分类:VHDL编程

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