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  1. 经典高速乘法器IP

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  2. 乘法器是硬件设计中的很常见也很重要的一个模块,它的VHDL硬件实现很好的解决了软件编程中做乘法速度慢的问题,在实时高速系统应用中或DSP软核或数字信号处理硬件实现算法中,经常能使用到乘法器,所以经典的高速乘法器IP 很有参考价值-Multiplier is a common and important module in hardware designing.Its VHDL addresses the low speed of multiplication in software progra
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:309363
    • 提供者:czy
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