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搜索资源列表

  1. wavefetch

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  2. ModelSim的波形比较的功能可以将当前仿真与一个参考数据(WLF文件)进行比较,比较的结果可以在波形窗口或者列表窗口中查看,也可以将比较的结果生成一个文本文件-ModelSim waveform can be compared to the current functional simulation with a reference (WLF paper ), the results can be compared in the waveform window or window List
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:3798
    • 提供者:cyberworm
  1. fpga_sec

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  2. 学习使用波形比较功能的基本方法,ModelSim的波形比较的功能可以将当前仿真与一个参考数据(WLF文件)进行比较,比较的结果可以在波形窗口或者列表窗口中查看,也可以将比较的结果生成一个文本文件-Learning to use the wave function of the basic method of comparison, ModelSim wave function can be compared with a reference current simulation (WLF fil
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:7559
    • 提供者:崔慧娟
  1. fifo

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  2. 同步FIFO 创建一个256x8大小的同步FIFO,并通过串口发送数据初始化FIFO,FPGA内部读取FIFO的数据通过窗口发送到PC-FIFO
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:4060
    • 提供者:赵云
  1. exp_micro_s

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  2. 自己在QuartusII9.1及Modelsim新版本中完成的microsequencer实例的工程文件。 1.echo uart,接收rx_data,再回复! 2.运行时请注意完整路径: D:\EXP\EXP_SOPCbuilder\exp_micro_s 3.UART数据输入问题? 3.1 MODELSIM中w完信号后,run/restart一次。 3.2 设置clock=20ns。 3.3 命令行中输入uart_drive调出uart_
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:5038900
    • 提供者:zh
  1. RISC_CPU

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  2. 1. RISC工作每执行一条指令需要八个时钟周期。RISC的复位和启动通过rst控制,rst高电平有效。Rst为低时,第一个fetch到达时CPU开始工作从Rom的000处开始读取指令,前三个周期用于读指令。 在对总线进行读取操作时,第3.5个周期处,存储器或端口地址就输出到地址总线上,第4--6个时钟周期,读信号rd有效,读取数据到总线,逻辑运算。第7个时钟周期,rd无效,第7.5个时钟地址输出PC地址,为下一个指令做好准备 对总线写操作时,在第3.5个时钟周期处,建立写的地址,第
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:1025903
    • 提供者:宋颖
  1. Example-b8-4

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  2. ModelSim的波形比较的功能可以将当前仿真与一个参考数据(WLF文件)进行比较,比较的结果可以在波形窗口或者列表窗口中查看-Comparison of the ModelSim wave functions , compare the results can be viewed on the waveform window or the list window
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7924
    • 提供者:lihao
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