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搜索资源列表

  1. usb_HLD3Core(400)_(B)

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  2. 接ADDA 板卡,外接信号源(峰峰值最大为1V),运行PC 端程序可 以将输入的信号源波形在PC 上显示出来,完成USB 的数据采集功能。-access ADDA Card, external signal source (peak to peak largest 1V), PC-operating procedures can be the source of the input signal waveform displayed on the PC, and complete USB d
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:599647
    • 提供者:fanbo
  1. SRAM-PINGPANG

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  2. 超声视频图像需要实时地采集并在处理后在显示器上重建,图像存储器就必须不断地写入数据,同时又要不断地从存储器读出数据送往后端处理和显示[11]。为了满足这种要求,可以在采集系统中设置2片容量一样的SRAM,通过乒乓读写机制来管理。任何时刻,只能有1片SRAM处于写状态,同时也只有1片SRAM处于读状态。工作期间,2片SRAM都处于读写状态轮流转换的过程,转换的过程相同,但是状态错开,从而保证数据能连续地写人和读出祯存.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1214
    • 提供者:smj1980
  1. SignalAcquisitionSystemDesignandImplementation

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  2. 随着社会的发展和科学技术的进步,现代社会对测量仪器的需 求越来越广,对仪器的性能要求也越来越高。在迅速发展的集成电 路技术和计算机技术的推动下,测量仪器也正发生巨大的变化。以 虚拟仪器为代表的新型测量仪器改变了传统仪器的思想,它们充分 利用计算机强大的软硬件功能,把计算机技术和测量技术紧密结合 起来。特别是基于计算机平台的各种测量仪器由于成本低、使用方 便等优点得到了更广泛的应用,在计算机普及率比较高的高等院校, 这种测量仪器对教学和科研都有重要的使用价值。 本文
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2387081
    • 提供者:hjh
  1. VHDL

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  2. 采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下: 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。 4.共有4个通道(ch1、ch2、ch3、ch4),每个通道配备100 Bytes的RAM,当存满数据后停止数据采集并且相应通道的状态位产生报警信号。 5.数据分为8位串行输出,输出时钟由外部数据读取电路给出。 6.具备显示模块驱动功能。由SEL信号设置显示的通道,DISPLAY
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5783271
    • 提供者:pengfu
  1. dianyabiao

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  2. 基于ISD4004的语音报值交直流电压表的设计:本文介绍了基于语音芯片ISD4004的语音报值交直流电压表的设计。电路由数据采集部分,A/D转换部分,键盘与显示部分,单片机控制部分,语音报值部分和扩展功能部分组成。电路使用了并行与串行总线相结合的方式,使设计与编程灵活简便。创意新颖有趣,富于人性化,避免了频繁观察仪器显示之苦,对减轻工程技术人员的工作量和提高工作效率现实意义。-ISD4004 voice-based value of AC and DC voltage at the design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-04-09
    • 文件大小:475463
    • 提供者:song
  1. AD

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  2. 基于ADC0809的数据采集系统,对0~5V电压采集,显示到数码管显示-ADC0809 based data acquisition system, for 0 ~ 5V voltage of the collection, display to the digital tube display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1172
    • 提供者:liuyong
  1. Digital_frequency_meter

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  2. 本项目基于等精度测量频率的原理,利用Verilog硬件描述语言设计实现了频率计内部功能模块,对传统的等精度测量方法进行了改进,增加了测量脉冲宽度的功能 采用STC89C52单片机进行数据运算处理,利用液晶显示器对测量的频率、占空比进行实时显示。充分发挥FPGA(现场可编程门阵列)的高速数据采集能力和单片机的高效计算与控制能力,使两者有机地结合起来。-The project is based on the principle of equal precision frequency measure
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-04
    • 文件大小:1339392
    • 提供者:swekey
  1. shuzidianyabiao

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  2. 系统基于EDA技术的智能数字电压表实现,以现场可编程门阵列(FPGA)为设计核心,集成于一片Xilinx公司的SpartanⅡE系列XC2S100E-6PQ208芯片上,在ISE环境下采用超高速硬件描述语言(VHDL)模块化编程,实现了电压的数据采集、转换、处理、显示等功能。本设计的特点在于能够测量的电压范围宽(0~50VDC),主要采用了分压原理,该系统具有集成度高、灵活性强、易于开发和维护等特点。-System based on EDA technology of intelligent d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-07-04
    • 文件大小:15360
    • 提供者:zhao
  1. tlc549adc

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  2. 利用状态机实现对TLC549的采样控制,改变ADC的模拟量输入值,数据采集读取后在数码管上显示。-State machine to achieve the TLC549 sampling control, to change the ADC analog input value, the data acquisition read on the digital tube display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:121580
    • 提供者:黄远豪
  1. ADC0809-data-collect-and-display

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  2. 采用VHDL设计ADC0809数据采集及显示体统, 顶层模块主要是将各个功能模块组合在一起,完成整体的功能。各个子模块作为元件,在顶层模块中对各个子模块例化,传递中间信号。-To VHDL design ADC0809 data acquisition and display the decency, top-level module is the various functional modules together to complete the overall functionality.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-10
    • 文件大小:135865
    • 提供者:Weimiao Cai
  1. ADC

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  2. 利用状态机实现对TLC549的采样控制,实验时可调节电位器RW1(在开发板底板左下角),改变ADC的模拟量输入值,数据采集读取后在数码管上显示。-Using state machine implementation of eight bits sampling control, adjustable potentiometer RW1 experiments in development board (bottom left corner), change the ADC analog inpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:300972
    • 提供者:珍宝
  1. 14_tlc549adc

    0下载:
  2. 利用状态机实现对TLC549的采样控制,实验时可调节电位器RW1(在开发板底板左下角),改变ADC 的模拟量输入值,数据采集读取后在数码管上显示。可以自己用万用表测一下输入电压, 然后与读取到的数据比较一下。注意:数码管显示的数据不是最终结果,还需要转换。-Using the state machine to achieve the TLC549 sampling control, experiment adjustable potentiometer RW1 (development
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:595623
    • 提供者:meiqiujun
  1. MOTION_DECT

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  2. 在EP3C16 FPGA开发板上实现了对数字摄像头的数据采集,颜色空间变换并进行摄像头中的运动物体进行检测,并实时的显示在VGA显示器上。使用quartus 10.0打开,注意不要使用中文路径。-In EP3C16 FPGA development board to achieve the right digital camera for data acquisition, color space conversion and for the camera to detect moving ob
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-24
    • 文件大小:1606656
    • 提供者:恣意
  1. ov7670-1

    0下载:
  2. ov7670摄像头FPGA数据采集、显示模块,测试可用-ov7670 camera, verilog code, video capture and display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6324852
    • 提供者:yexin
  1. ADS1118

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  2. 本设计是基于EP4CE15F17C8N和ADS1118的ADC数据采集和12864显示的程序-The design is based on a program EP4CE15F17C8N and ADS1118 ADC data acquisition and display of 12864
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:322079
    • 提供者:
  1. ADS8323

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  2. 本设计是基于EP4CE15F17C8N和ADS8323的16位ADC数据采集和12864显示的程序-The design is based on a program EP4CE15F17C8N and ADS8323 16-bit ADC data acquisition and display of 12864
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-28
    • 文件大小:629760
    • 提供者:
  1. scope_new

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  2. 本实验,为 ZX-2 开发板的综合实验,该实验利用 ZX-2 开发板上的 ADC、独 立按键、 UART 等外设, 搭建了一个具备丰富功能的数据采集卡, ZX-2 开发板负 责进行数据的采集并将数据通过串口发送到 PC 机上, PC 端,利用强大的串口调 试工具——串口猎人,来实现数据的接收分析,并将数据分别以波形、码表、柱 状图的形式动态显示出来,以让使用者能够直观的看到 ADC 采集到的信号细节。 同时,用户也可以使用串口猎人通过串口给下位机( FPGA) 发送指令,下位
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-15
    • 文件大小:24395805
    • 提供者:啧啧啧
  1. tlc549adc

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  2. 利用状态机实现对TLC549的采样控制,实验时可调节电位器RW1(在开发板底板左下角),改变ADC 的模拟量输入值,数据采集读取后在数码管上显示。可以自己用万用表测一下输入电压, 然后与读取到的数据比较一下。注意:数码管显示的数据不是最终结果,还需要转换。 转换方法: 比如,采样电压值为V ,ADC转换后读取的8位二进制数为D,Vref为参考电压值,这里是2.5V 那么以下等式成立: V=(D/256)*Vref-Using the state machine to ac
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:229734
    • 提供者:王鸿雪
  1. shiboqi

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  2. 数字示波器是数据采集,A/D转换,软件编程等一系列的技术制造出来的高性能示波器。显示效果不如模拟示波器,但是带宽大,功能丰富,已经成为测试的主流。-Digital oscilloscope is a data acquisition, A/D conversion, software programming, a series of technology to produce high performance oscilloscope. The display effect is not as
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:16549219
    • 提供者:吴立
  1. SMG

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  2. 实现将BCD码动态扫描显示在数码管上--verilog(The realization of dynamic scanning BCD code displayed on the digital tube --verilog)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-04
    • 文件大小:3072
    • 提供者:Yukioooo
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