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搜索资源列表

  1. router_routing

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  2. 片上网络NOC基于fpga实现的,routing模块。-NOC-chip networks realized fpga-based, routing module.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1033
    • 提供者:巴音
  1. DE2_NET

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  2. 基于altera公司EP2C35672C6的DE2板子的光盘中的自带文件。DE2_NET,网络模块。-Based on the DE2 board altera company EP2C35672C6 CD in its own file. DE2_NET, network modules.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1594161
    • 提供者:毛孩子
  1. myprojects

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  2. 同步数字复接的设计及其FPGA实现 在简要介绍同步数字复接基本原理的基础上,采用VHDL语言对同步数字复接各组成模块进行了设计,并在ISE集成环境下进行了设计描述、综合、布局布线及时序仿真,取得了正确的设计结果,同时利用中小容量的FPGA实现了同步数字复接功能。 基群速率数字信号的合成设备和分接设备是电信网络中使用较多的关键设备,在数字程控交换机的用户模块、小灵通基站控制器和集团电话中都需要使用这种同步数字复接设备。近年来,随着需要自建内部通信系统的公司和企业不断增多,同步数字复接设
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2397735
    • 提供者:chenysh
  1. router_fifo

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  2. 自己写的一个片上网络路由节点的fifo模块,工作频率达到1ghz。-Himself wrote a piece on the network routing node of the fifo module, the work frequency of 1ghz.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1378
    • 提供者:巴音
  1. router_fifo

    0下载:
  2. 自己写的一个片上网络路由节点的fifo模块,工作频率达到1ghz。-Himself wrote a piece on the network routing node of the fifo module, the work frequency of 1ghz.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1381
    • 提供者:巴音
  1. socdesignandtest

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  2. SoC是系统级集成,将构成一个系统的软/硬件集成在一个单一的IC芯片里,它一般包含片上总线、MPU核、SDRAM/DRAM、FLASH ROM、DSP、A/D、D/A、RTOS内核、网络协议栈、嵌入式实时应用程序等模块,同时,它也具有外部接口,如外部总线接口和I/O端口。通常,SoC中包含的一些模块是经过预先设计的系统宏单元部件(Macrocell)或核(Cores) ,或者例程(Routines),称为IP模块,这些模块都是可配置的,因此,基于SoC的设计方法学也称为基于IP的嵌入式系统设计
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:319913
    • 提供者:yyj
  1. nn_pid

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  2. 这是一个bp神经网络+PID控制器对飞行器控制系统的VHDL程序,其中模块并不完全,但大体模块都有,很有参考意义-This is a bp neural network controller for aircraft control system+PID VHDL program, which the module is not complete, but generally module has great reference significance
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:621670
    • 提供者:王力
  1. pe

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  2. 卷积神经网络当中的卷积模块,包括有测试程序,用硬件实现5*150的整列卷积-Convolutional neural network convolution module, including a test program, with hardware to achieve 5* 150 integer convolution
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-11
    • 文件大小:5761
    • 提供者:untruegrass
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