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LED点阵
- 大屏幕led点阵显示的驱动时序。 使用vhdl语言描述。其中rom文件可以使用lpm_megcore自动生成。-big screen led to the dot matrix display driver timing. The use of VHDL descr iption language. Rom which documents can be automatically generated using lpm_megcore.
44vhdl
- 44个vhdl实例 注1： 含有不可综合语句，请自行修改 注2： 一些PLD只允许I/O口对外三态，不支持内部三态，使用时要注意 注3: 设计RAM的最好方法是利用器件厂家提供的软件自动生成RAM元件，并在VHDL程序中例化-44 VHDL examples Note 1 : Includes an integrated statement, the initiative to revise Note 2 : Some PLD only allows I / O exte
systemcTOVerlogHDL
- 一个带波形输出的扫频模板systemC源程序， 该程序在SystemCStudio开发平台下生成， 实现systemC仿真、波形显示以及自动生成Verilog HDL代码。-waveform output with a sweep of the template systemC source, SystemCStudio the program development platform in the next generation, realize systemC simulation,
LFSR
- 自动生成线形反馈移位寄存器的各种HDL源代码和原理图的工具
CIC
- CIC IP core实现结构中自动生成的接口代码,基于软件无线电的应用，在毕业论文中已使用过。-CIC IP core to achieve the structure of the interface code automatically generated, based on software radio applications, has been used in the thesis.
Mul_16
- 16位布思乘法器，实现两个16位二进制相乘，运行runallcode.bat文件可自动生成fsdb波形文件观察结果-16bits-multibly-16bits buth mutiplayer
c2812rtdxtest_c2000_rtw
- 由MATLAB生成的RTDX的源代码，由模型搭建，然后自动生成DSP的源代码-RTDX generated by MATLAB source code, set up by the model, and then automatically generate DSP source code
4_1
- 四选一编程语言，可以自动生成四选一器件。-First elected four programming languages, you can automatically generate a four selected devices.
fir_compiler
- FIR编译器。自动生成具有用户自定参数的FIR滤波器。 在 matlab里面设计滤波器，matlab里面设计输入字长。生成的rtl代码是该文件的头部有位宽宏定义，可以自行查阅。 -FIR Compiler. Automatically generate a user-defined parameters of FIR filters. Design a filter inside the matlab, matlab which design input word length. Rtl
ddr2_model
- 从软件中自动生成的ddr2代码，是DDR2必不可少的 -Ddr2 code ~
sim_tb_top
- DDR2用软件自动生成的启动代码，是使用不可少的~-DDR2 start automatically generated by software code, is the use of essential ~
wiredly
- DDR2生成文件是使用DDR2不可少的代码，是软件自动生成的~-DDR2 DDR2 generated file is essential to use the code, the software automatically generated ~
sin2
- fpga正弦波发生函数，可用于自动生成rom文件-fpga sine wave generating function
FPGA-based-design-vending-machines
- 本系统采用了Altera的开发软件的Quarts II。该软件平台进行数字电路设计和仿真的方法；阐述了VHDL（Very High Speed Integrated Circuit Hardware Descr iption Language）语言的一些特点及语法结构；介绍了自动售货机系统的基本原理、系统组成和主要功能；并分析讨论了用VHDL语言开发自动售货机系统的设计流程。本设计利用Altera公司的开发软件Quartus II平台，采用VHDL硬件描述语言编程的设计方法设计系统核心电路的硬件
Automatically
- 硬件加速器自动生成白皮书 (PDF)里面有介绍alteraFPGA的硬件消息资料可以供初学者学习-Automatically generate the hardware accelerator white paper (PDF) which has introduced alteraFPGA hardware information can be found for beginners to learn
linux
- 在硬件电路的设计中，会产生大量的Verilog HDL代码，由于这些代码是自动生成的，其文件名没有实际意义，代码没有注释，也没有相关的说明文档，给阅读和理解带来了不便-In the hardware circuit design, will produce a large number of Verilog HDL code, the code is automatically generated, the file name of no practical significance, code
fifo
- 异步FIFO源代码，由模块调用自动生成，不包含测试向量。-Asynchronous FIFO source code automatically generated by the module calls, does not contain the testbench.
crc_tool
- 用c编写的自动生成并行crc处理的verilog代码的工具-Automatically generate the verilog code to parallel crc processing tools written with c
99mul_3
- 九九乘法表系统，ARH信号低电平时可手动输入乘数、被乘数；ARH高电平时自动生成乘数、被乘数进行99乘法计算。在自动过程中若ARH置0，则暂停当前自动生成的乘数、被乘数乘法运算，可进行外部输入，当ARH再次回到高电平1时，则返回暂停处的乘数、被乘数并继续向下运算。START信号具有一个复位重启的功能。-Nine nine multiplication table system, ARH signal in low level can be manually input multiplier, t
《图片COE和MIF文件的自动生成方法》
- 《 图片 COE 和 MIF 文件的自动生成方法 》(Automatic generation of images COE and MIF files)