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搜索资源列表

  1. clock_time

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  2. 本文件解压后clock_time.vhd采用编程环境maxplusII,完成时间秒定时、记时,设置时间秒、声光报警等功能。-this document unpacked clock_time.vhd maxplusII use programming environment, the time for completion seconds timing, Hutchison, the set-up time seconds, sound, light, alarm functions.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1609
    • 提供者:阿兰
  1. clock

    0下载:
  2. 用VHDL语言编写的一个闹钟程序,可以整点报时,设置时间,设置闹钟。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:767830
    • 提供者:zhg
  1. shizhongpaobiao

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  2. 一个识字跑表可以做秒表使用有设置时间等应有的功能课程设计很有用
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2297
    • 提供者:高飞
  1. clock

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  2. 以前做的EDA课程设计,CLOCK,可设置时间的,6位数码管显示-Done before the EDA curriculum design, CLOCK, may set the time, digital tube display 6
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1072372
    • 提供者:王志杰
  1. e7v4

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  2. 数字钟:显示,设置时间,设置闹铃(报时),秒表。 平台:quartusII 5.1。 说明:此版本中已将系统时钟调快,自己稍微改动一下即可,小小的考验,做出来会更有成就感!-digital clock:display time, set time, set alarm(use speaker to alarm), stopwatch. platform: quartusII 5.1 comment: there s a place to change if you want th
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:2020596
    • 提供者:kn
  1. 0133

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  2. 实现电子时钟功能,能够设置时间,最大时间精确度为0.01s-eletronic clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:419653
    • 提供者:zy
  1. DigitalClockBasedonVHDL

    0下载:
  2. 基于VHDL编写的数字钟,可以设置时间、闹钟,实现报时等功能。-Written in VHDL-based digital clock, can set time, alarm clock, to achieve timekeeping functions.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1758074
    • 提供者:陈慕繁
  1. VHDL

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  2. 这介其中一个人人一个程序的设置时间为settime-settime for settime
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:560640
    • 提供者:ztf
  1. clock

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  2. 用verilog语言编写的一个电子钟。能够显示时分秒,具有清零,设置时间的功能。-Verilog language with an electronic clock. Can display minutes and seconds, with a clear, set the time function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1174
    • 提供者:刘俊斌
  1. digtal_clock

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  2. 基于FPGA的24时制数字电子钟,设置时间,实现整点报时和闹钟功能。-FPGA-based 24-hour digital clock, set time, bring the whole point timekeeping and alarm functions.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:409184
    • 提供者:ben
  1. jiaotongdeng_c

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  2. 液晶屏显示时间,控制交通灯,可设置时间长短,由按键控制。-jiaotongdeng kongzhiqi,c daima
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:95724
    • 提供者:
  1. clock

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  2. 用FPGA实现的电子钟代码,可实现年、月、日、时、分、秒计时及整点报时功能,可以手动设置时间-FPGA implementation of the electronic clock code, year, month, day, hours, minutes, seconds, chronograph, and the whole hour, you can manually set the time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:157923
    • 提供者:袁敏杰
  1. SEG7_Timer

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  2. 一个采用数码管显示的数字钟,能设置时间和显示模式的切换-A digital display digital clock, can set the time and a display mode switching
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:9037721
    • 提供者:吴国强
  1. DC

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  2. 基于VHDL的数字时钟,包含设置时间,闹钟,以及整点报时的功能。设置时间和闹钟时数码管闪烁。-Based on VHDL digital clocks, including setting time, alarm clock, and the function of the time on the hour. Set a time when the alarm clock and digital tube twinkle.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1265750
    • 提供者:miffy
  1. WareContorl

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  2. 微波炉控制器,实现功能有:微波炉定时器,倒计时,开始,初始化,设置时间增减,停止的功能-Microwave oven controller features: microwave timer, the countdown to start, initialization, set the time to increase or decrease, stop function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1640640
    • 提供者:公子张
  1. m60

    0下载:
  2. 数字钟(for DE2 开发板) 1.‘时’、‘分’、‘秒’的十进制数字显示(小时从00~23)计时器。 2. 手动校时、校分、校秒的功能。 3.定时与闹钟功能,能在设定的时间发出闹铃声。 4.进行整点报时。从59分50秒起,每隔2秒钟发出一次低音“嘟”的信号,连续5次,最后一次发出高音“嘀”的信号,此信号结束即达到整点。 5、一个秒表,最低位1 秒、60秒,手动停止,手动重置。 6、一个倒计时,显示小时、分钟、秒,可设置时间。 -Decimal digital
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:907955
    • 提供者:dai
  1. clock

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  2. fpga实现电子时钟在数码管上显示,有设置时间功能。显示时分秒。-fpga electronic clock on the digital display, set the time function. Displayed every second.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:337522
    • 提供者:zhangyinfeng
  1. clock

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  2. FPGA时钟,vhdl,带设置时间,暂停,开始-FPGA clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:315565
    • 提供者:qiangge
  1. digital-colok

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  2. 用quartusII编写的vhdl代码,在板子上输出的显示就是数字钟,也可以重置、设置时间。-With written in VHDL quartusII code, the output is the digital clock is displayed on the board, you can also reset, and the time.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:10345472
    • 提供者:
  1. digital-clock-for-vhdl

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  2. 6数码管显示时钟,带调时功能,能设置闹钟,闹钟响可人为停止,整点报时,带屏保,12和24小时制手动切换,可人为设置时间为倒计时-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:10498
    • 提供者:廖宁
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