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搜索资源列表

  1. 656to601

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  2. 本程序实现视频图象的CCIR656转换CCIR601格式,使用的环境是Quartus II 4.0-the program CCIR656 video image conversion CCIR601 format, The environment is the use of Quartus II 4.0
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:564659
    • 提供者:吉克
  1. pcm13

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  2. PCM采编器器系统是一种常用的遥测设备,它可以采集多路数据并进行通信传输和数据处理,PCM 采编器控制采集各个数据通道数据的时序,并加上帧同步码形成一定格式的数据,再进行并/串转换,形成串行数据流送到调制设备供传送。-PCM Editor System is a common telemetry equipment, It can be multi-channel data acquisition and communication transmission and data processin
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:876
    • 提供者:张全文
  1. VerilogJIAOCHENG

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  2. 100多例Verilog HDL 经典编程,很适合Verilog初学者,我把它转换成pdf格式。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:113509
    • 提供者:刘英
  1. vgaout

    0下载:
  2. VHDL语言按VGA接口标准把数字图像信号转换成标准VGA格式。适合做学习试验-VHDL by VGA interface standards, digital image signal conversion into a standard VGA format. Suitable for the pilot study
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:6964
    • 提供者:余飞
  1. 用vhdl语言编写的2进制到10进制转换的程序

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  2. 本文为用vhdl语言编写的2进制到10进制转换的程序,为doc格式,使用前复制于maxplus等相应软件中使用。,This article was prepared by using VHDL language 2 hex to 10 hex conversion procedures for the doc format, the use of pre-replication in maxplus, such as the use of corresponding software.
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-22
    • 文件大小:2872
    • 提供者:网天才
  1. YCbCr2RGB

    0下载:
  2. 浮点数算法 ycbcr格式转换成rgb格式-float convert ycbcr to rgb
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:1374
    • 提供者:wda
  1. cameralink

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  2. 由于目前基于CameraLink接口的各种相机都不能直接显示,因此本文基于Xilinx公司的Spartan 3系列FPGAXC3S1000-6FG456I设计了一套实时显示系统,该系统可以在不通过系统机的情况下,完成对相机CameraLink信号的接收、缓存、读取并显示 系统采用两片SDRAM作为帧缓存,将输入的CameraLink信号转换成帧频为75Hz,分辨率为1 024×768的XGA格式信号,并采用ADV7123JST芯片实现数模转换,将芯片输出的信号送到VGA接口,通过VGA显示器显示
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:13232
    • 提供者:lilei
  1. ISP_FPGA_PAPER_04

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  2. 视频扫描格式转换算法设计及其芯片实现.nh-Video scan format conversion algorithm and its chip. Nh
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:9334301
    • 提供者:jiangyong
  1. color_conv

    0下载:
  2. BT656,YCBCR数据格式转换成VGA(888)数据算法,-BT656, YCBCR data format converted into VGA (888) data algorithm,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:845
    • 提供者:朱红梅
  1. vga_focus_code

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  2. 用VHDL编写的PAL转换为VGA格式的源代码,同时包括摄像头的自动变焦控制源码-PAL prepared using VHDL VGA format is converted to the source code, including the automatic zoom camera control source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:139374
    • 提供者:
  1. yuv_rgb

    0下载:
  2. 完成ITUR656标准的视频流数据向RGB格式的转换。-Complete video streaming ITUR656 standard data format to RGB conversion. Test module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:2016
    • 提供者:黄涛
  1. camera_link

    0下载:
  2. 对camera_link接口传输过来的信号进行格式转换,将16bit并行转换成串行输出-Right camera_link interface transfer over the signal format conversion will be converted into serial 16bit parallel output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1727436
    • 提供者:徐琪
  1. YCbCr2RGB

    0下载:
  2. 将图像数据Ycbcr格式转换为rgb格式,方便显示器显示。-Converting the image data Ycbcr format to RGB format , facilitating the monitor display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1350
    • 提供者:秦立红
  1. fix_float

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  2. 该程序的功能是将18位的定点数转换成15位(1,5,9)格式的浮点数,-The program' s function is to set the 18-bit conversion of 15 points (1,5,9) format floating-point,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:595743
    • 提供者:陈晓
  1. float_fixnumber

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  2. 将15位(1,5,9)格式的浮点数转换成18位的定点数-To 15 (1,5,9) floating-point format into 18 fixed points
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:374347
    • 提供者:陈晓
  1. ycrcb2rgb

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  2. 用verilog实现ycrcb至rgb的色彩空间格式转换,可综合-ycrcb to rgb colour space convey
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:22218
    • 提供者:郑大贤
  1. RGB2YCbCr

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  2. 视频格式空间转换 verilog语言实现-Space conversion video format verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-18
    • 文件大小:2048
    • 提供者:steven
  1. Verilog-to-VHDL-translator

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  2. 描述了一个Verilog到VHDL翻译器的设计与实现。首先将Verilog模块转换为中间格式,然后按照预定义的翻译规则,生成功能等价的VHDL设计实体。该翻译器目前只支持Verilog的一个子集。通过Verilog-to-VHDL, 使得在Verilog.VHDL混合设计环境中重用Verilog设计成为可能。-Describes a Verilog to VHDL translator design and implementation. Verilog module into first
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:194660
    • 提供者:liuyi
  1. pskdem_fixed

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  2. psk解调的定点仿真模型。另外DEC2HEX.C负责将十进制的数据文件转换为十六进制的数据文件,因为MATLAB输出数据格式为十进制,而NC-VERILOG能够读取的数据格式为十六进制,所以需要转换。-psk demodulation of the fixed-point simulation models. In addition DEC2HEX.C responsible for the data file is converted to decimal hex data file, as
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:11376
    • 提供者:杨芳
  1. file

    0下载:
  2. PAL-VGA格式转换器的设计,内部包含实现的FPGA代码-PAL-VGA format converter design, the internal code contains the implementation of the FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:7782368
    • 提供者:lipeng
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