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  1. 5555

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  2. 微波炉定时器集成电路的设计 1、 控制状态机:工作状态状态转换。 2、 数据装入电路:根据控制信号选择定时时间、测试数据或完成信号的装入。 3、 定时器电路:负责完成烹调过程中的时间递减计数和数据译码供给七段数码显示,同时还可以提供烹调完成时间的状态信号供控制状态机产生完成信号。 -microwave timer IC design a control state machine : state of the state conversion work. 2, data l
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:306217
    • 提供者:吴倩
  1. ADcaiyang

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  2. A/D采样控制模块设计 A/D采样控制模块负责控制外部ADC0809芯片多路模拟输入量的选通以及实现对A/D采样过程的合理控制。此部分的设计根据《EDA技术与VHDL》P211——P212的例8-2编写,所不同的是这里将书中“ADDA<=1”的赋值语句改为“ADDA <=EN”,EN是所设置的输入按键用来控制INO与IN1间的通道选择。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:881
    • 提供者:xuye
  1. SignalAcquisitionSystemDesignandImplementation

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  2. 随着社会的发展和科学技术的进步,现代社会对测量仪器的需 求越来越广,对仪器的性能要求也越来越高。在迅速发展的集成电 路技术和计算机技术的推动下,测量仪器也正发生巨大的变化。以 虚拟仪器为代表的新型测量仪器改变了传统仪器的思想,它们充分 利用计算机强大的软硬件功能,把计算机技术和测量技术紧密结合 起来。特别是基于计算机平台的各种测量仪器由于成本低、使用方 便等优点得到了更广泛的应用,在计算机普及率比较高的高等院校, 这种测量仪器对教学和科研都有重要的使用价值。 本文
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2387081
    • 提供者:hjh
  1. 1

    0下载:
  2. 设计一个八层楼房自动电梯控制器,用八个 LED显示电梯行进过程,并有数码管显示电梯当前所在楼层位置,在每层电梯入口处设有请求按钮开关,请求按钮按下则相应楼层的LED 亮。 用 CLK脉冲控制电梯运动,每来一个 CLK脉冲电梯升(降)一层。电梯到达有请求的楼层后,该层次的指示灯灭,电梯门打开(开门指示灯亮),开门 5 秒后,电梯门自动关闭,电梯继续运行。 控制电路应能记忆所有楼层请求信号,并按如下运行规则依次相应:运行过程中先响应最早的请求,再响应后续的请求。如果无请求则停留当前层
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:76864
    • 提供者:one song
  1. I2C.rar

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  2. FPGA实现模拟I2C协议的过程,包括三个模块,i2c_master_bit_ctrl.v完成位传输功能、i2c_master_byte_ctrl.v完成字节传输功能,i2c_master_top.v完成整个程序的控制功能,并提供给外部程序的接口。 ,I2C Analog FPGA implementation of the Protocol process, including the three modules, i2c_master_bit_ctrl.v achieve bit tran
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:11625
    • 提供者:leo
  1. temperature

    0下载:
  2. 使用FPGA控制18B20达到温度采集过程,并显示在数码管上。-Achieved using the FPGA control 18B20 temperature acquisition process and display the digital pipe.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:1778
    • 提供者:彭杨
  1. zzx

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  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 写完一看,一个并串转换居然搞了这么大,有点失败。但是整个代码已经通过了后仿真,而且思路还是比较清楚的,可靠性和稳定性方面也应该没有问题滴,呵呵。不过说老实话,里面有些信号是确实可以去掉的,不过后来就懒
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:7011
    • 提供者:zzx
  1. VHDL

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  2. 采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下: 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。 4.共有4个通道(ch1、ch2、ch3、ch4),每个通道配备100 Bytes的RAM,当存满数据后停止数据采集并且相应通道的状态位产生报警信号。 5.数据分为8位串行输出,输出时钟由外部数据读取电路给出。 6.具备显示模块驱动功能。由SEL信号设置显示的通道,DISPLAY
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5783271
    • 提供者:pengfu
  1. CodeLock

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  2. 用于模仿密码锁的工作过程。完成密码锁的核心控制功能。可实现数码输入、清除、退位、设置密码、错误提示、系统报警、解除报警、系统关闭等功能。-Used to imitate the work of the code lock process. Locks achieve the core control functions. Digital input can be achieved, clear, step down, set a password, error message, the syst
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:13639
    • 提供者:胡婕
  1. mimasuo

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  2. 模仿密码锁的工作过程。完成密码锁的核心控制功能。-To imitate the work of the process of locks. Locks achieve the core control functions.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:347141
    • 提供者:庄青青
  1. chuanbingzhuanhuan

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  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 -And the string conversion of the code is relying on the synchronization state machine to achieve its c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1009
    • 提供者:盛忠良
  1. 8caideng

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  2. 试设计一种彩灯控制器控制8盏灯。该彩灯控制器有4种自动切换的花样。第一种花样为彩灯从右到左,然后从左到右逐次点亮,全灭全亮;第二种花样为彩灯两边同时亮一个逐次向中间移动再散开;第三种花样为彩灯两边同时亮两个逐次向中间移动再散开;第四种花样为彩灯两边同时亮三个,然后四亮四灭,四灭四亮,最后一灭一亮。四个花样自动变换,重复以上过程。输入时钟频率为500Hz,灯亮的时间在1—4秒之间,可以自由控制。电路中以“1”代表灯亮,以“0”代表灯灭。-Lantern try to design a contro
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1400
    • 提供者:liruigang
  1. diantikongziqi

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  2. 电梯控制器的设计与分析.对电梯的控制过程进行VHDL语言描述。-Elevator controller design and analysis. On the elevator control process described in VHDL language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:422304
    • 提供者:水牛EDA
  1. plc

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  2. QSPLC系列可编程控制器实验 数码显示的模拟控制 交通灯的模拟控制(控制过程、I/O分配、控制语句表、梯形图)-QSPLC series programmable controller experimental digital display analog analog control traffic light control (control process, I/O distribution, control statement table, ladder)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:308530
    • 提供者:马琳
  1. washer

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  2. 根据全自动洗衣机的控制原理设计一个控制电路,使之能够控制洗衣机全自动完成浸泡、洗涤、漂洗、脱水(甩干)等整个工作过程;或者由用户选择,洗衣机单独执行“浸泡”、“洗涤”、“漂洗”、“脱水”中的某个洗衣程序。-Automatic washing machine control principle according to design a control circuit, to enable automatic control of washing machines to complete soak
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:518124
    • 提供者:邓云鹏
  1. sw-led

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  2. 用一个开关SW来控制一个灯的开与关,程序简单,可以用来熟悉开发过程。-SW with a switch to control the opening and off a light, simple procedures can be used to familiar with the development process.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:3903
    • 提供者:陆景鹏
  1. seg_led_display

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  2. 数码管灯控制程序,动态扫描过程。硬件连接方式比较特殊,位选单独控制,又是级联方式。6个数码管。-Digital tube light control applications, dynamic scanning process. Hardware connection is rather special, separate control of Choice, but also a cascade. 6 digital control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:2656
    • 提供者:lichenlin
  1. six_led_display

    0下载:
  2. 数码管灯控制程序,动态扫描过程。硬件连接方式比较特殊,位选单独控制,又是级联方式。6个数码管。-Digital tube light control applications, dynamic scanning process. Hardware connection is rather special, separate control of Choice, but also a cascade. 6 digital control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2652
    • 提供者:lichenlin
  1. Process-control-module-VHDL-code

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  2. 此为基于FPGA的直流伺服系统的设计,具体为过程控制模块VHDL代码-This is the dc servo system based on FPGA design, specific for process control module VHDL code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:8983
    • 提供者:黄平
  1. traffic

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  2. 模拟交通灯变化过程控制的VHDL程序,用红黄绿LED灯表示交通灯,用数码管显示状态剩余时间-Control procedures and VHDL simulation traffic lights change process, with red, yellow, and green LED lights, traffic lights, with a digital display of the status of the remaining time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:1471
    • 提供者:sxb
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