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MAX+PLUSII软件是一个功能强大，容易使用的软件包，它可以以图
形方式、文字输入方式（AHDL、VHDL和VERILOG）和波形方式输入设计文
件，可以编译并形成各种能够下装到EPROM和各种ALTERA器件的文件，还可
以进行仿真以检验设计的准确性，下面举例说明该软件的使用-MAX+ PLUSII software is a powerful, easy-to-use software package, which can graphically, text input me
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关于频率计程序的设计，LCD控制程序，PSK调制解调的控制程序，MSK调制解调控制程序，电梯控制程序，TLC5510控制程序，基带码发生器程序，电子琴程序，自动售货机程序，电子时钟程序，步进电机控制定位系统，波形发生器，出租车计价器，ADCO809-Procedures regarding the design of frequency meter, LCD control procedures, PSK modulation and demodulation of the control pr
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安徽省首届大学生电子设计竞赛，用VHDL编写的程序任意波形产生器-Anhui first Undergraduate Electronic Design Contest, using VHDL procedures for the preparation of Arbitrary Waveform Generator
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用VHDL语言设计三人表决器
新建VHDL设计文件并保存
检查编译
波形仿真
-Design using VHDL language VHDL three new voting system for the design document and save it to check the compiler waveform simulation
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用Verilog编写I2C的接口程序，I2C的为主，测试通过并带有整体模块设计方法和方针波形-Prepared using I2C interface Verilog programs, I2C of the main, the test adopted and with the overall modular design methods and guidelines for the waveform
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采用VERILOG语言的计数器的设计，经过前仿和后仿，仿真波形正确，适用于初学者学习VERILOG语言-Using VERILOG design language of the counter, through the imitation of pre-and post-simulation, the simulation waveform is correct, for beginners to learn the language VERILOG
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FPGA交通灯说明：
1. 本程序使用VHDL加原理图方式设计而成。
2. 实验时，使用Quartus II软件完成了工程管理与下载验证，使用max+plus II软件进行了功能仿真。
3. 由于实验当时对原理图文件缺乏足够的认识，导致原原理图以及仿真输出文件已经丢失。现在的工程 RTL视图以及仿真输出波形均是在Quartus II软件下得到的。-FPGA traffic lights shows:1procedures for the use of the VHDL sch
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本程序为分频程序，在函数发生器的设计中它能够实现频率的控制，从而可以使得函数发生器能够输出不同频率的波形-The procedures for the points frequency program, in the design of the function generator in it can realize the frequency control, which can make function generator can output the frequency of diffe
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The reference design and example presented in this article illustrates how you can add a DDS (direct digital synthesis) waveform generator to your LabVIEW FPGA based applicationThe examples for this article are contained in a LabVIEW 8.5.1 project.
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是一个关于EDA的完整课程设计，汽车尾灯的控制，里面包括源程序代码级仿真波形，功能说明等，需要的额下载吧-it is a Curriculum design for EDA with Quartus，it contains all program and Simulation waveform files，if you need，you can download
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采用VHDL实现的CPU设计代码，工程中包含测试波形。包含CPU设计文档，如指令格式设计和各功能模块说明和指令测试序列，能下载到实验台上直接运行。-CPU design is realized by VHDL Language, the project contains the test waveform. Contains the CPU design documents, such as directives format, instructions for each function mo
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频率计程序设计与仿真。本文为DOC文档，附有源码和仿真波形，详见文档-Frequency meter program design and simulation, this paper for the DOC document, attached to the source code and simulation waveform
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设计并实现一个可产生正弦波、三角波和锯齿波的波形发生器。其工作频率为60MHz，可产生1MHz、2MHz、3MHz、4MHz、5MHz、6MHz、10MHz的正弦波、三角波和锯齿波。所产生波形的幅度、相位均可调整，输出数据的字长为12比特。应用环境为quartus 2-Design and implement a can produce sine, triangle, and sawtooth waveform generator. The operating frequency of 60MH
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实验要求：
（1）画出5位逐级进位和超前进位加法器的电路图，要求在图中表明输入、输出信号、中间信号等全部相关的信号，且信号命名应和图中的标注一一对应；
（2）不能使用课本中的FOR循环语句，VHDL的赋值语句应和电路图一一对应；
（3）VHDL代码和仿真波形要保存。
（4）关于超前进位加法器，可以参照课本P160设计。
（5） 要求提交设计报告，按照深大实验报告的标准格式，同时需要代码，仿真结果和综合电路图。 -The experimental requirements:
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实验要求：
（1）画出5位逐级进位和超前进位加法器的电路图，要求在图中表明输入、输出信号、中间信号等全部相关的信号，且信号命名应和图中的标注一一对应；
（2）不能使用课本中的FOR循环语句，VHDL的赋值语句应和电路图一一对应；
（3）VHDL代码和仿真波形要保存。
（4）关于超前进位加法器，可以参照课本P160设计。
（5） 要求提交设计报告，按照深大实验报告的标准格式，同时需要代码，仿真结果和综合电路图。 -The experimental requirements:
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信号发生器设计
信号发生器由波形选择开关控制波形的输出, 分别能输出正弦波、方波和三角波三种波形, 波形的周期为2秒（由40M有源晶振分频控制）。考虑程序的容量,每种波形在一个周期内均取16个取样点,每个样点数据是8位(数值范围:00000000~11111111)。要求将D/A变换前的8位二进制数据（以十进制方式）输出到数码管动态演示出来。-Signal generator design
The signal generator is controlled by waveform se
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