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搜索资源列表

  1. serial

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  2. 该程序用vhdl 编写,模拟串口工作,对上位机发送数据在串口调试工具下显示,接受上位机数据在数码管上显示-Vhdl prepared to use the program to simulate the serial port work, send data to the PC serial port debug tools in the next showed that IPC data in digital tube display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:2869
    • 提供者:gjp_rain
  1. FPGA

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  2. FPGA应用开发入门与典型实例 代码 FPGA(现场可编程逻辑器件)以其体积小、功耗低、稳定性高等优点被广泛应用于各类电子产品的设计中。本书全面讲解了FPGA系统设计的背景知识、硬件电路设计,硬件描述语言Verilog HDL的基本语法和常用语句,FPGA的开发工具软件的使用,基于FPGA的软核嵌入式系统,FPGA设计的基本原则、技巧、IP核, FPGA在接口设计领域的典型应用,FPGA+DSP的系统设计与调试,以及数字变焦系统和PCI数据采集系统这两个完整的系统设计案例。 -FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:10980798
    • 提供者:海到无涯
  1. serial

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  2. 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。 程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控制器,10个bit是1位起始位,8个数据位,1个结束位。-The module' s function is to verify the implementation and the basic PC, the serial communication function. Installed on the PC req
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:327559
    • 提供者:hechunzhi99
  1. rs232

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  2. FPGA与PC串口调试工具通信程序,包括收和发两个过程。-Program for communication between FPGA and the PC serial port debug tool ,including sending and receiving processes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2727
    • 提供者:peiren
  1. modelsim_image_processing

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  2. 使用fpga开发图像处理时往往会遇到各种困难,调试周期比较长,尤其是输入输出接口。但我们想先研究算法,所以这里给出了一个工具,可以帮助我们实现这个功能。这个工具作为辅助工具,算法实现部分可以通过modelsim来完成-Image processing using fpga development often will encounter various difficulties, debug cycle is relatively long, especially input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:2034225
    • 提供者:zhaojkun
  1. DDR2_Control

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  2. 本文档以Siga-S16 Spartan 6的FPGA开发板为例,为大家介绍用MIG工具生成DDR2控制器,并用ChipScope调试DDR2读写的方法。 -This document in the FPGA development board Siga-S16 Spartan 6 as an example, to introduce the formation of DDR2 controller with the MIG tool, and use the debug method of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10853734
    • 提供者:ad
  1. SSRAM_250M

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  2. 本人编写的SSRAM高速读写工程,工程中包含了NIOS软核,利用Quartus的TimeQuest工具进行了时序约束,上班调试最高读写速率可达250MHz。-I write the SSRAM high-speed, speaking, reading and writing, engineering includes NIOS soft core, timing constraint is studied by using Quartus TimeQuest tools, work to de
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-14
    • 文件大小:22659527
    • 提供者:王虎
  1. FPGA

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  2. FPGA调试的方法及常用工具 对初学者帮助很大-Methods and tools used to debug FPGA great help for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:58174
    • 提供者:反而更
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