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SOPCBuilder
- SOPC Builder教程,其中详细的介绍了SOPC Builder与matlab一起构建系统并加以实现的方案，确实值得一看-SOPC Builder Guide, which describes in detail the SOPC Builder system and build with matlab and the realization of the program is indeed worth a visit
yufafenxiqi
- 该程序能求出任意给定的文法的所有非终极符和终极符的first集，所有非终极符的follow集，所有语句的select集，能求出能导空的非终极符集合。给定任意字符串该程序能判定出是否能接受。由于空符号不好输入，在程序中用到空符号全部用@表示。-The program can calculate any given grammar of all non-ultimate breaks and the ultimate symbol of the first set, all non-ultimate
verilog
- 《Verilog HDL 程序设计教程》王金明著，课后习题答案，内附多种器件程序，并附程序目录-" Verilog HDL Programming Guide" Wang Jinming with, Homework answer, containing a variety of devices program, along with program directory
source
- 《Verilog HDL程序设计教程》程序例子 带说明。对于要精通学习Verilog HDL者，有重要的帮助作用，里面全是源代码，供大家学习参考。-" Verilog HDL Programming Guide" program example with instructions. For those who want to master learning Verilog HDL, there is a great help, which all the source code
verilog
- 一个很好的关于verilog的PPT 第1章 EDA设计与Verilog HDL语言概述 第2章 Verilog HDL基础与开发平台操作指南 第3章 Verilog HDL程序结构 第4章 VERILOG HDL语言基本要素 第5章 面向综合的行为描述语句 第6章 面向验证和仿真的行为描述语句 第7章 系统任务和编译预处理语句 第8章 VERILOG HDL可综合设计的难点解析 第9章 高级逻辑设计思想与代码风格 第10章 可综合状态机开发实例 第1
verilog
- 第1章 EDA设计与Verilog HDL语言概述 第2章 Verilog HDL基础与开发平台操作指南 第3章 Verilog HDL程序结构 第4章 VERILOG HDL语言基本要素 第5章 面向综合的行为描述语句 第6章 面向验证和仿真的行为描述语句 第7章 系统任务和编译预处理语句 第8章 VERILOG HDL可综合设计的难点解析 第9章 高级逻辑设计思想与代码风格 第10章 可综合状态机开发实例 第11章 常用逻辑的VERILOG HDL实现
XST-User-Guide
- 在Xilinx FPGA环境下，所有涉及的高级Verilog语言的语法都有讲到，还附有例子程序-In the Xilinx FPGA environment, all involved have a high-level Verilog language syntax mentioned, but also with an example program
System_Demons
- 0.最简单的SystemC程序：hello, world. 1.用SystemC实现D触发器的例子，同时也演示了如何生成VCD波形文件。 2.用SystemC实现同步FIFO的例子。这个FIFO是从同文件夹的fifo.v（verilog代码）翻译过来的。 3.如何在SystemC中实现延时（类似verilog中的#time）的例子。 4.SystemC文档《User Guide》中的例子。注意和文挡中稍有不同的是修改了packet.h文件，重载了=和<<操作符。这其实
RISC-CPU
- 精简指令集 CPU 通过仿真验证正确 (使用之前务必看readme文件，和结构图!) 1. 此cpu是夏宇闻 verilog数字系统设计教程中最后一章的例程。 2. 学习时务必先搞明白框图原理，和数据流动！！！ 3. 牢记主状态机中一条指令周期中传输的16bit=3bit指令+13bit地址。 4. 理解数据总线，和地址总线。区分数据和地址。 5. 仔细调试，因为书中有很多小错误。 程序经过quartusii编译通过，另外经过modelsim仿真正确。-RISC
US-Navy-VHDL-Modelling-Guide
- 该标准的硬件和可靠性项目的产品（SHARP），技术独立电子产品的代表（TIREP）工程美国海军研究实验室（NRL），海军的合作努力水面作战中心（NSWC）开发FPGA的使用标准。-A Product of the Standard Hardware And Reliability Program (SHARP), Technology Independent Representation of Electronic Products (TIREP) Project A coopera