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  1. 计数器

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  2. 简单的硬件描述语言verilog语言描述的128进制计数器。(Simple hardware descr iption Language Verilog language described 128 binary counter.)

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  1. 浮点数加法ip

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  2. 这是两个浮点数实现加法的ip，用于硬件描述语言。这是组内做机器人项目时自己编写使用的。

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