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搜索资源列表

  1. full_add

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  2. 一个用VHDL语言编写的8位全加器,并且扩展了减法功能,带有状态位的判断。-a VHDL prepared by the eight-adder, and extends the subtraction function, with state-of judgment.
  3. 所属分类:其它

    • 发布日期:2008-10-13
    • 文件大小:124574
    • 提供者:陈晓岚
  1. ADDER8B

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  2. 8位加法器VHDL 8位加法器VHDL-eight Adder VHDL e ight Adder VHDL eight Adder VHDL 8 Adder VHDL
  3. 所属分类:编译器/词法分析

    • 发布日期:2008-10-13
    • 文件大小:45064
    • 提供者:秦顺金
  1. C_9

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  2. 100个经典vhdl编程实例, 第1例 带控制端口的加法器 第2例 无控制端口的加法器 第3例 乘法器 第4例 比较器 第5例 二路选择器 第6例 寄存器 第7例 移位寄存器 第8例 综合单元库 第9例 七值逻辑与基本数据类型 第10例 函数 第11例 七值逻辑线或分辨函数 第12例 转换函数 第13例 左移函数 第14例 七值逻辑程序包 第15例 四输入多路器...... -100 vhdl classical programmi
  3. 所属分类:书籍源码

    • 发布日期:2008-10-13
    • 文件大小:337411
    • 提供者:袁虎
  1. sdgshjd

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  2. 数字系统设计这是有关的相关源代码,有简易CPU 除法器、计数器等 ...[fpdiv_vhdl.rar] - 四位除法器的vhdl源程序 [vhdl范例.rar] - 最高优先级编码器8位相等比较器 三人表决器(三种不同的描述方式) 加法器描述 8位总线收发器:74245 (注2) 地址译码(for m68008) 多路选择器(使 BR> ... -Digital System Design This is the underlying source code, a simple C
  3. 所属分类:并行运算

    • 发布日期:2008-10-13
    • 文件大小:838
    • 提供者:张瑞
  1. adder

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  2. 运用VHDL语言实现四位超前进位加法器。-VHDL language using the four CLA.
  3. 所属分类:MPI

    • 发布日期:2017-03-27
    • 文件大小:4327
    • 提供者:吴伟
  1. vhdl

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  2. 半加器 或门 1位二进制全加器顶层设计描述-Half adder or a binary gate full adder top-level design descr iption
  3. 所属分类:source in ebook

    • 发布日期:2017-03-27
    • 文件大小:989
    • 提供者:chengfeng
  1. ADDER

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  2. 本设计是用32位的并行全加器的,可以实现浮点运算!-The design is a parallel 32-bit full adder, and floating-point operations can be achieved!
  3. 所属分类:MiddleWare

    • 发布日期:2017-03-22
    • 文件大小:278443
    • 提供者:王强
  1. 2008619105258431

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  2. 九个输入,一个输出,实现四位全加器,四位全加器的功能-9 input, 1 output, to achieve four full-adder, four full-adder function
  3. 所属分类:Editor

    • 发布日期:2017-04-05
    • 文件大小:963453
    • 提供者:fst_yiran
  1. Chapter1-5

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  2. 第一章到第五章的代码 本书通过100多个模块实例,详细地讲解了Verilog HDL程序设计语言,全书共分13章,内容涉及VerilogHDL语言基本概念、建模、同步设计、异步设计、功能验证等,实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、SPIMaster Controller、I2C Master controller、CAN ProtocolController、Memory模块、JPEG图像压缩模块、加密模块、ATA控制器、8位RISC-CPU等及各个实例
  3. 所属分类:source in ebook

    • 发布日期:2017-04-09
    • 文件大小:1580139
    • 提供者:xiao
  1. RippleCarryadder

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  2. Ripple Carry Adder, This is simple adder circuit implemented in VHDL, date delay can be studied using this circuit.
  3. 所属分类:assembly language

    • 发布日期:2017-04-01
    • 文件大小:674
    • 提供者:kinnar
  1. add

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  2. 单片机vhdl设计的加法器 运行的芯片为PIC208-adder
  3. 所属分类:assembly language

    • 发布日期:2017-04-06
    • 文件大小:70196
    • 提供者:jimgreen
  1. csa8

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  2. vhdl code four 4-bit carry select adder
  3. 所属分类:ELanguage

    • 发布日期:2017-11-20
    • 文件大小:356963
    • 提供者:soha
  1. VHDL

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  2. 74LS161 JK触发器带清0端,项目名称为dff_JK_111 十进制计数器74LS290,项目名定为CTLS290:运算方法编写的290计数器:另一种编法LS290 不带使能端的3线8线译码器 八选一数具选择器:用CASE语句 全加器: 简单的JK触发器-74LS161 JK flip-flop with cleared end Project Name dff_JK_111 decade counter 74LS290 project name as CTLS290: and comp
  3. 所属分类:assembly language

    • 发布日期:2017-11-09
    • 文件大小:6772
    • 提供者:Lynn
  1. 32-bit-cla-adder

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  2. This a code that describe 32 bit carry look ahead adder in VHDL(32 bit CLA).-This is a code that describe 32 bit carry look ahead adder in VHDL(32 bit CLA).
  3. 所属分类:assembly language

    • 发布日期:2017-11-08
    • 文件大小:767
    • 提供者:hskim
  1. full-adder

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  2. vhdl program of full adder
  3. 所属分类:assembly language

    • 发布日期:2017-05-01
    • 文件大小:322609
    • 提供者:shobi khan
  1. Adder-Code

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  2. 4 bit adder vhdl code
  3. 所属分类:assembly language

    • 发布日期:2017-04-30
    • 文件大小:46226
    • 提供者:Japerski
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