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搜索资源列表

  1. clk_generator

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  2. 基于Verilog HDL的任意分频代码，由本人原创，可实现0.000001Hz的步进，跟网络上的大部分简单地分频不一样！-Devicetor descr ipted by Verilog，can reach 0.0000001Hz！

  3. 所属分类：ELanguage

    • 发布日期：2017-04-02
    • 文件大小：862
    • 提供者：hanbin

  1. filter

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  2. 数字滤波器的verilog语言程序，为双精度的滤波器，可以实现10k低通滤波-verilog filter

  3. 所属分类：ELanguage

    • 发布日期：2017-04-15
    • 文件大小：6665
    • 提供者：meng

  1. uart-master

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  2. verilog语言实现URAT串口通信，便捷开发(Implementation of various basic circuits in digital circuits with Verilog language)

  3. 所属分类：易语言编程

    • 发布日期：2018-01-03
    • 文件大小：3072
    • 提供者：Maren
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