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搜索资源列表

  1. dianzishizhong

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  2. 题目:电子时钟的设计 一、实验目的: 1. 掌握多位计数器相连的设计方法。 2. 掌握十进制、六十进制、二十四进制计数器的设计方法。 3. 继续巩固多位数码管的驱动及编码。 4. 掌握扬声器的驱动 5. 掌握EPLD技术的层次化设计方法 二、实验要求: 1.用时、分、秒计数显示功能,以24小时循环计时。 2.具用清零,调节小时、分钟功能。 3.具用整点报时功能。
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:167964
    • 提供者:li
  1. jisuanqi

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  2. 4位8段数显十进制加计数器原理图与传真-PCB下载站-jisuanqi
  3. 所属分类:Software Testing

    • 发布日期:2017-04-02
    • 文件大小:23319
    • 提供者:yang
  1. jiaotongxinhaodengkongzhiqidesheji

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  2. 本论文主要介绍了红、绿、黄三色交通信号灯较简单的数字逻辑控制电路设计及其原理。本设计方案由定时器、分频器、扭环形计数器、十进制减法器及七段显示译码器实现交通灯红、黄、绿三色的自动切换,在切换灯光颜色的同时进行时间定时状态的切换,使整个交通灯系统得以按照事先设定的定时时间顺利运转。-This paper focuses on the red, green, yellow three-color traffic signal control of the relatively simple digi
  3. 所属分类:Project Design

    • 发布日期:2017-04-09
    • 文件大小:1248291
    • 提供者:阿杰
  1. Decimal_counter_based_design_MAX_PLUS

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  2. 基于MAX_PLUS_的十进制计数器的设计Decimal counter based design MAX_PLUS_-Decimal counter based design MAX_PLUS_
  3. 所属分类:Software Testing

    • 发布日期:2017-04-16
    • 文件大小:293667
    • 提供者:kimi
  1. trtgh4P944

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  2. 8位十进制计数器,采用Verilog语言编写,成功与大家分享一下-8-bit decimal counter, use Verilog language, to share with you about my success
  3. 所属分类:software engineering

    • 发布日期:2017-04-25
    • 文件大小:95295
    • 提供者:李永科
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