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搜索资源列表

  1. uart16750_latest.tar

    0下载：
  2. Implements a 16550/16750 UART core

  3. 所属分类：Com Port

    • 发布日期：2017-04-17
    • 文件大小：99936
    • 提供者：Arun

  1. uart16750

    0下载：
  2. UART 16750 source code for VHDL

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-02
    • 文件大小：151253
    • 提供者：maxshao

  1. uart16750_latest.tar

    0下载：
  2. UART 16750 VHDL core

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-16
    • 文件大小：136900
    • 提供者：Joe

  1. uart16750_latest[1].tar

    0下载：
  2. uart 16750 core discripe with VHDL language

  3. 所属分类：MPI

    • 发布日期：2017-03-27
    • 文件大小：137335
    • 提供者：asdtgg

  1. uart16750_latest.tar

    0下载：
  2. UART 16750 Source Code

  3. 所属分类：3G develop

    • 发布日期：2017-04-16
    • 文件大小：137321
    • 提供者：ByoungSoo

  1. uart16750_latest.tar

    0下载：
  2. Implements a synthesizable 16550/16750 UART core.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-26
    • 文件大小：137326
    • 提供者：Juanjo

  1. wb_uart_latest.tar

    0下载：
  2. 实现一个一16750/16550 UART。该UART内核是完全基于另一个OpenCores的项目：UART_16750塞巴斯蒂安维特。 请找到有关于UART内核的文档。 该接口是现在有8位Wishbone总线兼容。 随着GHDL模拟器只需运行： ./ghdl_uart.bat 使用任何其他模拟器，开始模拟以下perl脚本必须运行之前： uart_test_stim.pl> FILENAME.TXT 其中，FILENAME.TXT是通用的“stim_

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-28
    • 文件大小：21695
    • 提供者：包

  1. UART_16750_vhdl

    0下载：
  2. UART串口FPGA源文件，VHDL设计文件，兼容16750-UART FPGA VHDL 16750

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-05
    • 文件大小：23295
    • 提供者：yp
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