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扰码器Verilog
0
下载：
实现扰码的功能，主要为64位在pcs子层传输的扰码器设计(To achieve the functions of scrambling code)
所属分类：
VHDL/FPGA/Verilog
发布日期：2018-04-30
文件大小：521216
提供者：
不会飞的小胖
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