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  1. r_w_SD2304

    0下载:
  2. 这是时钟芯片时SD2304的底层访问函数。希望大家能有用。-This is the time clock chip SD2304 visit to the bottom function. Hope that we can be useful.
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:1355
    • 提供者:lllzf
  1. PICC

    0下载:
  2. PIC的一些例子程序 PIC的一些例子程序 PIC的一些例子程序
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2014-01-16
    • 文件大小:1355
    • 提供者:laishw1
  1. UART0 接收1

    0下载:
  2. msp430 串口模拟程序-Serial Controller Simulation Program
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:1355
    • 提供者:可可
  1. DA

    0下载:
  2. ad7303 驱动程序 microchip
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:1355
    • 提供者:tata1982
  1. 一个12C5A的PWM程序

    0下载:
  2. 一个12C5A的PWM程序
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2011-06-03
    • 文件大小:1355
    • 提供者:zhenghangzheng8
  1. keyboard

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  2. 键盘程序:基于cpld开发环境的4*4键盘程序,很有用哦-Keyboard procedure: CPLD-based development environment 4* 4 keyboard procedures, useful Oh
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-24
    • 文件大小:1355
    • 提供者:xixi
  1. servotest-custom

    0下载:
  2. 比赛中使用的简易舵机控制程序 硬件环境为C8051F-simple servo control procedures ,for the use of the C8051F
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-28
    • 文件大小:1354
    • 提供者:killer
  1. verilog_Manchester

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  2. 曼彻斯特码编码电路,在工业电路中有较好的抗干扰性,而且编码电路简单,容易在FPGA上实现-Manchester encoding circuit, the circuit in the industry in a better anti-interference, and the coding circuit is simple, easily implemented on FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1354
    • 提供者:史江城
  1. dac

    2下载:
  2. DA芯片输出控制 SPI协议 只写不读 FPGA用 verilog-DA-chip SPI protocol output control does not read write-only FPGA with verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:1354
    • 提供者:wuzhongpeng
  1. AD_fsm

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  2. AD7892的状态机VHDL代码。完成时序控制,4通道数据采集和AD转换。-the FSM of AD7892
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1354
    • 提供者:马寅
  1. main

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  2. arm c语言编程-the arm c language programming
  3. 所属分类:Other Embeded program

    • 发布日期:2017-12-07
    • 文件大小:1354
    • 提供者:fanghuan
  1. rxpart

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  2. uart异步串口收模块,将串口数据进行组合变成8位的字节。波特率可自行调节-uart receive asynchronous serial module, serial data will be combined to become 8 bytes. The baud rate of self-regulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1354
    • 提供者:郭先生
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