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文件名称:bcdmaxianshiyiyunsuan

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    760.39kb
  • 已下载：
    0次
  • 提 供 者：
    shen****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

设计一个四舍五入判别电路，其输入为8421BCD码，要求当输入大于或等于5时，判别电路输出是1，反之为0。-Design a rounded discrimination circuit, the input 8421BCD code requirements when the input is greater than or equal to 5, the discrimination circuit output is 1, otherwise 0.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

bcdmaxianshiyiyunsuan.doc

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