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文件名称:ram_control_17_xian

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-01-15
  • 文件大小：
    86.25kb
  • 已下载：
    0次
  • 提 供 者：
    zhang******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于VHDL的ram控制器，8根输入，8根输出，1根读写控制线。实现ram的读写控制-The ram controller based on VHDL, 8 input and 8 output, a read-write control lines. Ram read and write control
(系统自动生成,下载前可以参看下载内容)

下载文件列表

ram_control_17_xian/
ram_control_17_xian/_xmsgs/
ram_control_17_xian/ram0.asy
ram_control_17_xian/ram0.ngc
ram_control_17_xian/ram0.sym
ram_control_17_xian/ram0.v
ram_control_17_xian/ram0.veo
ram_control_17_xian/ram0.vhd
ram_control_17_xian/ram0.vho
ram_control_17_xian/ram0.xco
ram_control_17_xian/ram0_flist.txt
ram_control_17_xian/ram0_readme.txt
ram_control_17_xian/ram0_xmdf.tcl
ram_control_17_xian/ram_control_17_xian.ise
ram_control_17_xian/ram_control_17_xian.restore
ram_control_17_xian/ram_control_17_xian.vhd
ram_control_17_xian/ram_control_17_xian_xdb/
ram_control_17_xian/ram_control_17_xian_xdb/tmp/
ram_control_17_xian/templates/
ram_control_17_xian/templates/coregen.xml
ram_control_17_xian/tmp/
ram_control_17_xian/tmp/_cg/
ram_control_17_xian/xlnx_auto_0.ise
ram_control_17_xian/xlnx_auto_0_xdb/
ram_control_17_xian/xlnx_auto_0_xdb/tmp/

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