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文件名称:clock_div

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-10-21
  • 文件大小：
    11.21mb
  • 已下载：
    0次
  • 提 供 者：
    a***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

verilog编写的分频器,基于计数器编写的-divider verilog prepared
(系统自动生成,下载前可以参看下载内容)

下载文件列表

clock_div/
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clock_div/DOC/工程说明文档.txt
clock_div/DOC/设计方案说明.docx
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clock_div/RTL/clock_div.v
clock_div/RTL/clock_div.v.bak
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clock_div/clock_div.done
clock_div/clock_div.fit.rpt
clock_div/clock_div.fit.smsg
clock_div/clock_div.fit.summary
clock_div/clock_div.flow.rpt
clock_div/clock_div.jdi
clock_div/clock_div.map.rpt
clock_div/clock_div.map.summary
clock_div/clock_div.pin
clock_div/clock_div.qpf
clock_div/clock_div.qsf
clock_div/clock_div.sof
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clock_div/clock_div.sta.summary
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clock_div/db/altsyncram_st14.tdf
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