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文件名称:wb_sdram_ctrl.tar

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2014-12-20
  • 文件大小：
    10.23kb
  • 已下载：
    0次
  • 提 供 者：
    cor****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

Generic Wishbone R3 compliant SDRAM controller written in Verilog
(系统自动生成,下载前可以参看下载内容)

下载文件列表

wb_sdram_ctrl/
wb_sdram_ctrl/bench/
wb_sdram_ctrl/bench/wb_sdram_ctrl_tb.v
wb_sdram_ctrl/bench/README
wb_sdram_ctrl/rtl/
wb_sdram_ctrl/rtl/verilog/
wb_sdram_ctrl/rtl/verilog/dual_clock_fifo.v
wb_sdram_ctrl/rtl/verilog/sdram_ctrl.v
wb_sdram_ctrl/rtl/verilog/wb_port_arbiter.v
wb_sdram_ctrl/rtl/verilog/wb_sdram_ctrl.v
wb_sdram_ctrl/rtl/verilog/bufram.v
wb_sdram_ctrl/rtl/verilog/dpram_generic.v
wb_sdram_ctrl/rtl/verilog/wb_port.v
wb_sdram_ctrl/rtl/verilog/dpram_altera.v

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