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文件名称:xuexidds

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2016-10-13
  • 文件大小：
    37.88kb
  • 已下载：
    0次
  • 提 供 者：
    刘***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

利用quartus平台使用verilog语言实现直接数字频率合成-Use quartus platform verilog language Direct Digital Synthesis
(系统自动生成,下载前可以参看下载内容)

下载文件列表

xuexidds/
xuexidds/acc.bsf
xuexidds/acc.v
xuexidds/acc_bb.v
xuexidds/adder.bsf
xuexidds/adder.v
xuexidds/address_decode.bsf
xuexidds/address_decode.v
xuexidds/addrlatch.bdf
xuexidds/atof.bsf
xuexidds/atof.v
xuexidds/control.bsf
xuexidds/control.v
xuexidds/count.bsf
xuexidds/count.v
xuexidds/count_bb.v
xuexidds/db/
xuexidds/db/dds.db_info
xuexidds/db/dds.sld_design_entry.sci
xuexidds/db/prev_cmp_dds.qmsg
xuexidds/dds.bdf
xuexidds/dds.done
xuexidds/dds.qpf
xuexidds/dds.qsf
xuexidds/dds.v
xuexidds/e1.bdf
xuexidds/lshift.bsf
xuexidds/lshift.v
xuexidds/lshift_bb.v
xuexidds/m.bdf
xuexidds/multam.bsf
xuexidds/multam.v
xuexidds/multam_bb.v
xuexidds/ram.bsf
xuexidds/ram.v
xuexidds/ram_bb.v

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