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文件名称:SPC3-RW

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2017-05-24
  • 文件大小：
    3.74mb
  • 已下载：
    0次
  • 提 供 者：
    刘***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用FPGA完成对SPC3芯片的读写程序，并附有仿真测试程序。-Using FPGA to complete SPC3 chip to read and write procedures, with the simulation test program.Using FPGA to complete SPC3 chip to read and write procedures, with the simulation test program.
(系统自动生成,下载前可以参看下载内容)

下载文件列表



基于FPGA的SPC3读写程序\20160118.cfi
......................\20160118.mcs
......................\20160118.prm
......................\20160118.sig
......................\a.v
......................\a_beh.prj
......................\a_isim_beh.exe
......................\a_isim_beh.wdb
......................\a_isim_beh1.wdb
......................\a_stx_beh.prj
......................\coregen_xil_884_46.cgc
......................\coregen_xil_884_46.cgp
......................\fuse.log
......................\impact.xsl
......................\impact_impact.xwbt
......................\init.bgn
......................\init.bit
......................\INIT.bld
......................\INIT.cmd_log
......................\init.drc
......................\init.gise
......................\INIT.lso
......................\INIT.ncd
......................\INIT.ngc
......................\INIT.ngd
......................\INIT.ngr
......................\INIT.pad
......................\INIT.par
......................\INIT.pcf
......................\INIT.prj
......................\INIT.ptwx
......................\INIT.stx
......................\INIT.syr
......................\INIT.twr
......................\INIT.twx
......................\init.ucf
......................\INIT.unroutes
......................\INIT.ut
......................\INIT.v
......................\INIT.xpi
......................\INIT.xst
......................\INIT_bitgen.xwbt
......................\INIT_envsettings.html
......................\INIT_guide.ncd
......................\INIT_isim_beh.exe
......................\INIT_map.map
......................\INIT_map.mrp
......................\INIT_map.ncd
......................\INIT_map.ngm
......................\INIT_map.xrpt
......................\INIT_ngdbuild.xrpt
......................\INIT_pad.csv
......................\INIT_pad.txt
......................\INIT_par.xrpt
......................\INIT_summary.html
......................\INIT_summary.xml
......................\INIT_usage.xml
......................\INIT_xst.xrpt
......................\ipcore_dir\CLL\clk_wiz_readme.txt
......................\..........\...\CLL.ucf
......................\..........\...\doc\clk_wiz_ds709.pdf
......................\..........\...\...\clk_wiz_gsg521.pdf
......................\..........\...\example_design\CLL_exdes.v
......................\..........\...\..............\CLL_exdes.vhd
......................\..........\...\implement\implement.bat
......................\..........\...\.........\implement.sh
......................\..........\...\.........\xst.prj
......................\..........\...\.........\xst.scr
......................\..........\...\simulation\CLL_tb.v
......................\..........\...\..........\CLL_tb.vhd
......................\..........\...\..........\functional\simcmds.tcl
......................\..........\...\..........\..........\simulate_isim.sh
......................\..........\...\..........\..........\simulate_mti.do
......................\..........\...\..........\..........\simulate_ncsim.sh
......................\..........\...\..........\..........\simulate_vcs.sh
......................\..........\...\..........\..........\ucli_commands.key
......................\..........\...\..........\..........\vcs_session.tcl
......................\..........\...\..........\..........\wave.do
......................\..........\...\..........\..........\wave.sv
......................\..........\CLL.asy
......................\..........\CLL.ejp
......................\..........\CLL.gise
......................\..........\CLL.ncf
......................\..........\CLL.v
......................\..........\CLL.veo
......................\..........\CLL.vhd
......................\..........\CLL.vho
......................\..........\CLL.xco
......................\..........\CLL.xco.bak
......................\..........\CLL.xise
......................\..........\CLL_flist.txt
......................\..........\CLL_xmdf.tcl
......................\..........\coregen.cgc
......................\..........\coregen.cgp
.............

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