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文件名称:lab3

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-09-20
  • 文件大小：
    27kb
  • 已下载：
    0次
  • 提 供 者：
    cadet******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

booth算法移位乘 使用verilog(Booth algorithm shift multiply Verilog)
相关搜索： booth verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

lab3\booth.qpf
lab3\booth.qsf
lab3\booth.qws
lab3\booth.v
lab3\booth.v.bak
lab3\db\booth.cbx.xml
lab3\db\booth.cmp.rdb
lab3\db\booth.db_info
lab3\db\booth.hif
lab3\db\booth.ipinfo
lab3\db\booth.map.qmsg
lab3\db\booth.map.rdb
lab3\db\booth.map_bb.hdb
lab3\db\booth.pti_db_list.ddb
lab3\db\booth.sld_design_entry.sci
lab3\db\booth.smart_action.txt
lab3\db\booth.tis_db_list.ddb
lab3\db\logic_util_heursitic.dat
lab3\db\prev_cmp_booth.qmsg
lab3\output_files\booth.flow.rpt
lab3\output_files\booth.map.rpt
lab3\output_files\booth.map.summary
lab3\db
lab3\output_files
lab3

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