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文件名称:用VHDL设计移位寄存器

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2017-12-04
  • 文件大小：
    141kb
  • 已下载：
    0次
  • 提 供 者：
    放飞的***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

实现序列检测，让你通过VHDL语言实现序列数字的发生(Sequence detector code)
相关搜索： vhdl

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
用VHDL设计移位寄存器.doc 239616 2010-11-28

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