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文件名称:serdes verilog 仿真模型

  • 所属分类：
    开源硬件
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2020-07-27
  • 文件大小：
    2.16kb
  • 已下载：
    1次
  • 提 供 者：
    ar_dong
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

serdes verilog 仿真模型
20位输入输出
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : test_serdes.zip 列表
test_serdes/serdes_rx.v
test_serdes/serdes_tx.v
test_serdes/test_serdes.v

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