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文件名称:Modelsim_fredevider_testbench_TEXTIO

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    249.82kb
  • 已下载：
    1次
  • 提 供 者：
    二*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

此文档通过分频器的例子描述了如何使用modelsim，如何编写testbench以及textio的使用-This document is an example through the divider describes how to use the modelsim, how to write a testbench and use textio
相关搜索： textio modelsim textio veril testbench textio Veril Modelsim_fredevider_testbench_TEXTIO Modelsim text

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Modelsim+分频器+testbench+TEXTIO.doc

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