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搜索资源列表

  1. cnt

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  2. 俩个比较好的计数器的vhdl代码:一个是n位通用计数器,一个是的用到的语法比较全面。是比较好的学习资料-Both a relatively good counter VHDL code: one is the generic n-bit counter, one is the syntax used in the more comprehensive. Is a better learning materials
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1052
    • 提供者:郭新稳
  1. main

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  2. 含从0开始计数,蜂鸣器定时鸣叫,LCD显示功能等正常-buzzer,cnt
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:1403
    • 提供者:李小如
  1. cnt

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  2. 对输入时钟做除以8的分频和除以4的分频功能-Does the input clock frequency divided by 8 and divided by the number of sub-4 sub-frequency function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:118102
    • 提供者:chujiang
  1. divNfreq

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  2. 参数化分频器,以5为例,能很方便的扩展到参数N-osedge and negedge using common counter "cnt" parameter N is the double number of frequence division
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:764
    • 提供者:leng
  1. drv7279

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  2. 本程序将指定的显示缓冲区送显,并将读取的键值送显。 入口参数:显示缓冲区首地址在SADR中,要显示的位数在CNT中。 出口参数: 无。-This procedure will be sent to the designated display buffer significantly, the key will be sent to a significant reading. Entrance parameters: the first address in the display b
  3. 所属分类:SCM

    • 发布日期:2017-04-13
    • 文件大小:1554
    • 提供者:liu gang
  1. t1

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  2. 实现电机M/T法测速的VHDL代码,只要修改cnt值大小即可修改M/T法切换的频率,当小于cnt时为T法,大于时为M法。-Motor M/T method velocimetry of the VHDL code, as long as the modified value of cnt to modify the size of M/T method of frequency switching, when cnt is less than for the T method, for M gr
  3. 所属分类:VHDL编程

    • 发布日期:2013-07-07
    • 文件大小:520
    • 提供者:tianson
  1. CNT

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  2. 分频的VHDL语言描述,巨简单实用,一看就会,从2到16分频都有,好东西啊。-Sub-band descr iption of the VHDL language, giant simple and practical, one can see, from 2-16 pm band has, ah good things.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1127
    • 提供者:江山
  1. CS18-2

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  2. 定时中断。采用定时器T0,定时50ms,每次定时溢出引起中断,在中断程序中对计数器累加。每一秒LED亮0.2s,熄0.8s。 特色:低功耗。程序中技巧在于将1s分成cnt记20次,0.2秒占20 ,即中断的前4次都点亮,后16次都熄灭。-Interrupted from time to time. The use of timer T0, from time to time 50ms, each caused by overflow from time to time interrupted
  3. 所属分类:SCM

    • 发布日期:2017-04-09
    • 文件大小:669
    • 提供者:j_lang
  1. 1

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  2. 已知数据文件IN.DAT中存有200个四位数,并已调用读函数readDat()把这些数存入数组a中,请考生编制一函数jsVal( ),其功能是:如果四位数各位上的数字均是0或2或4或6或8,则统计出满足此条件的个数cnt,并把这些四位数按从大到小的顺序存入数组b中。最后main( )函数调用写函数writeDat()把结果cnt以及数组b中符合条件的四位数输出到OUT.DAT文件中。-There are known data file IN.DAT in 200 four-digit, and
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-28
    • 文件大小:530
    • 提供者:房飞洒
  1. Probe01

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  2. SuperProbe - 17 Function! The Superprobe project was designed to see how much could be done with a PIC chip and just a few parts. The image at the right shows the capacitance measuring mode. This device is designed around a PIC16F870, a 4 d
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-13
    • 文件大小:3088248
    • 提供者:Vlad
  1. vhdl

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  2. 当接收到一个信号(D_start)时,开始计时,再收到另一个信号(D_stop)时,计时结束,得到计时时间A,然后将时间A与给定时间B进行比较,如果小于时间B,程序结束,进行下一环节(LED),否则返回重新等待计时(cnt:=0)-When receiving a signal (D_start), the start time, and then received another signal (D_stop), the time the end of time by time A, then
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:5054
    • 提供者:Devine
  1. CNT-LED

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  2. MEGA128 计数 4位LED数码管显示-MEGA128 count 4 LED digital display
  3. 所属分类:SCM

    • 发布日期:2017-03-29
    • 文件大小:32815
    • 提供者:代德勇
  1. Advanced

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  2. 实现AD采集卡的AD DIO cnt DA功能-AD DIO
  3. 所属分类:SCM

    • 发布日期:2017-05-17
    • 文件大小:5110419
    • 提供者:张飞
  1. jishuqi

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  2. 实现计数和分频,用于高精度频率计数器的设计,在一个模块内实现-frenquent cnt
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:1444
    • 提供者:王华燕
  1. chuan2bing

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  2. Verilog语言实现的串行输出转换位并行输出的程序代码,并生成模块电路图-module b_c(dout,clk,clr,din) output dout input [3:0] din input clk,clr reg dout reg [3:0] q reg [1:0] cnt always@(posedge clk) begin cnt<=cnt+1 if(clr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:1691073
    • 提供者:zhanghf
  1. stm32-tim-counter-vf

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  2. stm32 tim counter 文档经典合集97 vf伏压变换 tim cnt模式 频率采样-stm32 tim counter
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-23
    • 文件大小:21034
    • 提供者:lianlian
  1. cnt

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  2. 在ise开发环境下,建立顶层模块和子模块的层次结构,其实现的功能是一个可复位课暂停开始继续的建议秒表-In ise development environment, establish a hierarchy of top-level modules and sub-modules, and its function is to achieve a resettable class resumes proposal to suspend the stopwatch
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3090615
    • 提供者:喻国芳
  1. CNT

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  2. 基于DSP芯片实现采样、开入开出量解析、开关位置判断、功率计算等功能-Based on the DSP chip to achieve sampling, open out the amount of analysis, switch position judgment, power calculation and other functions
  3. 所属分类:DSP program

    • 发布日期:2017-12-13
    • 文件大小:23106
    • 提供者:方也
  1. encoder

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  2. stm32编码器模式及中断配置,可以利用stm32读取正交编码器。CNT寄存器没10000代表一圈,每一圈产生一个中断,可以实时读取每一圈CNT值,以及总圈数(Stm32 encoder mode and interrupt configuration, you can use stm32 to read the quadrature encoder. CNT register no 10000 on behalf of a circle, each lap to produce an inte
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2017-12-20
    • 文件大小:1024
    • 提供者:chichichi
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