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X-HDL_3.2.55_license
- X-HDL软件是可以智能地实现vhdl<->verilog之间的相互转换的软件，不仅仅是语法转换，而是使用了hdl技术。这是该软件x-hdl3.2.55的license注册补丁，非常难得。
SPIsend.rar
- Verilog HDL的程式，上網找到SPI程式， vspi.v這程式相當好用可用來接收與傳送SPI，並且寫了一個傳輸信號測試，spidatasent.v這程式就是傳送的資料，分別為00 66... 01 77...... 02 55這樣的資料，並透過MAX+PULS II軟體進行模擬，而最外層的程式是test_createspi.v！,Verilog HDL programs, Internet find SPI program, vspi.v this very useful progra
X-HDL3.2.52
- vhdl和Verilog HDL相互转换的软件，很难找的一款-vhdl and Verilog HDL mutual conversion software, very difficult to find a
HW3_P1
- Clock Controller There are often situations where one wishes to pass a predetermined number of clock pulses and then stop. The purpose of this problem is to design a controller in VHDL to gate a preset number of pulses form a free-running clock “CL
top_clock
- VerilogHDL编译基本功能具有“秒”、“分”、“时”计时功能，小时按24小时制计时。具有校时功能，能对“分”和“小时”进行调整。扩展功能 仿广播电台正点报时。在59分51秒、53秒、55秒、57秒发出低音512Hz信号，在59分59秒时发出一次高音1024Hz信号，音响持续1秒钟，在1024Hz音响结束时刻为整点。 定时控制，其时间自定； 可任意设定时间的闹钟 自动报整点小时数 小时显示：可切换12小时/24小时显示-VerilogHDL compile the ba
verilog_testbench_genetator
- 这是一个perl程序 只需要在cmd中运行，参数为你的Verilog名字 功能是:半自动生成Verilog的testbench，提高编码效率-#-----READ ME of verilog_tb_generate.pl----------------------| # | #-----copyright(C) Xzmeng 2010---------------
jiaotongdeng
- A方向为主干道，B方向为支干道。分设红（R）、黄(Y)、绿(G)和左拐(L)四盏灯。1表示灯亮，0表示灯灭。四灯的点亮顺序为：绿灯→黄灯→左拐灯→黄灯→红灯，A方向四个时间为55秒（红）、40秒（绿）、5（黄）秒和15（左拐灯）秒；B方向的四个时间为65秒（红）、30秒（绿）、5秒（黄）和15（左拐灯）秒。时间要改变只要改变计数器的预知数即可。-A direction for the main road, B direction of branch roads. Divided red (R),
Traffic-light-design
- (1) 能显示十字路口东西、南北两个方向的红、黄、绿的指示状态； • 用两组红、黄、绿三色灯作为两个方向的红、黄、绿灯，能实现正常的倒计时功能； • 用两组数码管作为东西和南北方向的到计时显示，显示时间为红灯55秒、绿灯50秒、黄灯5秒； *(2) 按S1键后，能实现特殊状态功能: • 显示到计时的两组数码管闪烁； • 计数器停止计数并保持在原来的状态； • 东西、南北、路口均显示红灯状态； • 特殊状态解
digital-clock
- 此数字钟具有时，分，秒计时并显示功能； 2.能进行24/12小时制计时模块的切换； 3.具有校时，清除功能，能对时，分，秒进行调整； 4.具有整点报时功能：在59分51秒，59分53秒，59分55秒，59分57秒发出低音256HZ信号，在59分59秒发出一次高音1024HZ信号，音响持续一秒钟，在1024HZ音响结束时刻即为整点； -This digital clock with hours, minutes, seconds, chronograph and display
uart-frame
- 原来的uart9010程序发送接收端顺序翻了，更正了错误，完成了协议帧的处理，注意 rst要接复位，来初始化输入格式55 f1 41 01020304 ee验证码是ee 程序中可改。-The original uart9010 program to send the order turned the receiver, correct the error, complete the protocol frame processing, attention rst to take res
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- 基础实验_06_优先译码器 ：优先译码器-Experimental basis _06_ priority decoder: Priority Decoder
trafficlight
- 在FPGA上对模拟交通灯进行模拟，红灯亮55秒，其他灯各亮5s。-traffic light
55
- 基础实验_10_移位寄存器 ：常见普通移位寄存器-Basic experiment _10_ shift register: common ordinary shift register
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- 设计一个具有时、分、秒计时的电子钟，按24小时计时。要求： （1）数字钟的时间用六位数码管分别显示时、分、秒； （2）用两个控制键，对数字钟分别进行分、时校正； （3）具有仿广播电台整点报时的功能。即每逢59分51秒、53秒、55秒及57秒时，发出4声500Hz低音，在59分59秒时发出一声1kHz高音，它们的持续时间均为1秒。最后一声高音结束的时刻恰好为正点时刻。 （4）具有定时闹钟功能，且最长闹铃时间为1分钟。要求可以任意设置闹钟的时、分；闹铃信号为500Hz和1kHz的方波信号，两