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搜索资源列表

  1. jiafa

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  2. vhdl的加法计算，用于初学者熟悉vhdl语言-for the newers to get familier with vhdl

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-25
    • 文件大小：211560
    • 提供者：无敌

  1. jiafa

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  2. 基于QUTER的VHDL言语的加法器设计-Based on the words of the QUTER VHDL adder design

  3. 所属分类：VHDL编程

    • 发布日期：2017-04-07
    • 文件大小：128524
    • 提供者：shenlina

  1. jiafa

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  2. 实现AD采样进来的5路信号相加、比较，判决，输出控制码 实现数字自动增益控制-AD sample the incoming signal sum, comparison, judgment, and output control codes to implement digital AGC

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-03
    • 文件大小：1085577
    • 提供者：谭振伟
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